參數(shù)資料
型號： IBM2520L8767
廠商： IBM Microeletronics
英文描述： IBM Asynchronous Transfer Mode Processor for ATM Resources(IBM異步轉(zhuǎn)換模式 ATM資源管理微處理器)
中文描述： IBM的異步傳輸模式ATM的處理器資源（IBM的異步轉(zhuǎn)換模式自動柜員機資源管理微處理器）
文件頁數(shù)： 452/573頁
文件大?。?/td> 7235K
代理商： IBM2520L8767
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IBM2520L8767
IBM Processor for ATM Resources
ATM Cell Handler Architecture: Receive Direction
Page 432 of 553
atmrm.chapt06.01
08/27/99
ATM Cell Handler Architecture: Receive Direction
ACH_Rx GPP Handler Address Mapping
Base Address = x’200
Register Name
Description
Address Offset
Type Width
Initial Value
ROFmid
read-on-the-fly register
X’0’
F 8
’00000000’
ROFhi
read-on-the-fly register (MSByte)
X’1’
F 8
’00000000’
CntEn1
COUNT ENABLE register
X’2’
X 4
’0000’
FHR
Counter, ATM cells written into external FIFO, no threshold
X’4/5’ *
N 24
’x’000000’’
IHR
Counter, received Idle cells from OFP, no threshold
X’6/7’ *
N 24
’x’000000’’
EHR1
Counter, detected HEC errors with threshold
X’8/9’ *
N 16
’x’0000’’
EHR1Th12
Threshold reg Byte2 (LSByte) for counter EHR1
X’A’
X 8
’00000001’
EHR1Th11
Threshold reg Byte1 for counter EHR1
X’B’
X 8
’10000000’
BHR
Counter, FIFO full discarded cells: (DiscPAF1=1) AND
(TxLpB11=0) with threshold. 2
X’C/D’ *
N 16
’x’0000’’
BHRTh12
Threshold reg Byte2 (LSByte) for counter BHR
X’E’
X 8
’00000001’
BHRTh11
Threshold register Byte1 for counter BHR
X’F’
X 8
’10000000’
RESET
Default RESET register
X’30’
R 2
’01’
CMD1
Command register (FIFO reset)
X’31’
O 2
’00’
STAT1
status register
X’33’
S 6
MainIRQ
MAIN INTerrupt register
X’38’
I 2
M_MainIRQ
INTerrupt MASK register (for MainIRQ)
X’39’
X 2
’00’
CntrIRQ1
COUNTER INTerrupt register
X’3A’
I 6
M_CntrIRQ1
INTerrupt MASK register (for CntrIRQ1)
X’3B’
X 6
’000000’
CONF5
Chiplet configuration register
X’48’
C 8
’00000011’
CONF6
Chiplet configuration register (Alpha/Delta)
X’49’
C 8
’01100101’
H1CONF
1
X’4A’
C 8
’00000000’
H2CONF
1
X’4B’
C 8
’00000000’
H3CONF
1
X’4C’
C 8
’00000000’
H4CONF
1
X’4D’
C 8
’00000001’
H5CONF
Dummy byte to align Payload in external FIFO
X’4E’
C 8
’11010000’
CONFC
External FIFO buffer Almost Full threshold
X’4F’
C 7
’1100000’
1. Confirmation bytes to identify Idle or Unassigned cells.
2. Meaning of counter address marked as (*) Independant of the counter width, given that a counter has chiplet address N as a
base, reading address N or address N-1 both yield the Least Significant Byte of the counter. Reading address N has no effect on
the counter but reading address N-1 resets the counter after read operation.
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