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參數(shù)資料
| 型號(hào)： | IBM2520L8767 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Asynchronous Transfer Mode Processor for ATM Resources(IBM異步轉(zhuǎn)換模式 ATM資源管理微處理器) |
| 中文描述： | IBM的異步傳輸模式ATM的處理器資源（IBM的異步轉(zhuǎn)換模式自動(dòng)柜員機(jī)資源管理微處理器） |
| 文件頁(yè)數(shù)： | 31/573頁(yè) |
| 文件大小： | 7235K |
| 代理商： | IBM2520L8767 |
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IBM2520L8767
IBM Processor for ATM Resources
atmrm.chapt01.01
08/27/99
Internal Architecture
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Internal Architecture
Logical Channel Support
The Logical Channel is the unit of resource allocation in ATM. At one level, the End Station negotiates with
the Network Interface to determine the characteristics of each end Station to End Station connection. The
resources that may be reserved in the network are defined in the ATM UNI (User Network Interface) Specifi-
cation (see references in
Standards Compliance
on page 3). These resources include (but are not limited to)
the peak and average bandwidth to be used by the logical channel, the maximum burst length that may be
transmitted at the burst rate, the latency and variance of the connection, and the loss probability.
The term Logical Channel rather than virtual circuit or VPI/VCI is used in this databook to provide a level of
abstraction from these specific instances.
A Switched Virtual Circuit (SVC) can be negotiated with specific characteristics specifically for it.
A virtual path can be negotiated with the network, and several virtual circuits within that path can then be mul-
tiplexed using the VCI on that single VPI without having to renegotiate for each additional VCI. The Logical
channel with respect to the network would be the Virtual Path. There would be multiple logical channels inter-
nal to the end station based on the Virtual Circuits used within the path.
Using ATM Adaptation Layers 3 and 4, a Multiplexing IDentifier (MID) can be used to provide multiple Logical
Channels across a single VPI/VCI.
All of these Logical Channels are dealt with uniformly in the IBM2520L8767. A hierarchy of Logical Channel
Descriptors can be built up, and Frames or buffer can be queued to each of the LCDs. See
Transmit Cell
Scheduler (CSKED)
on page 223 for details.
Virtual Memory Support
The Packet memory space appears on the bus as if it is up to 64K buffers each of which can (architecturally)
appear to be 64K bytes long. A level of indirection has been added to the addressing of Packet memory to
provide these large frame buffers without requiring memory behind all of them at the same time. This has
been done for a number of reasons:
The Frames on the network can be up to 64KB long.
The receiver does not know how long a frame will be until it is completely received.
Software generally has a much easier time of dealing with contiguous memory.
The memory does not page or swap. There two major efficiencies used internally:
The first N bytes of memory in a buffer are directly referenced.
The blocks that make up the buffers are of multiple sizes.
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