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參數(shù)資料
| 型號： | ARM7TDMI-S |
| 英文描述： | ARM7TDMI-S Microprocessor Core preliminary technical manual 5/00 |
| 中文描述： | 的ARM7TDMI - S微處理器核的初步技術(shù)手冊5 / 00 |
| 文件頁數(shù)： | 94/184頁 |
| 文件大小： | 1147K |
| 代理商： | ARM7TDMI-S |
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5-10
Coprocessor Interface
Rev. A
Copyright 2000 by LSI Logic Corporation. All rights reserved.
5.5.7 Coprocessor Load and Store Operations
The coprocessor load and store instructions transfer data between a
coprocessor and memory. They can transfer either a single word of data,
or a number of the coprocessor registers. There is no limit to the number
of words of data that a single LDC or STC instruction can transfer, but
by convention no coprocessor should transfer more than 16 words of
data in a single instruction.
Figure 5.4
shows an example sequence.
Note:
If you transfer more than 16 words of data in a single
instruction, the worst-case interrupt latency of the
ARM7TDMI-S core will increase.
Figure 5.4
Coprocessor Load Sequence
5.6 Connecting Coprocessors
A coprocessor in an ARM7TDMI-S system needs to have 32-bit
connections to:
data from memory (instruction stream and LDC)
write data from the ARM7TDMI-S (MCR)
read data to the ARM7TDMI-S (MRC)
TST
CLK
Fetch Stage
Decode Stage
SWINE
(ADD)
Execute Stage
CPnI
CPA
CPB
RDATA[31:0]
(From Coprocessor)
(From Coprocessor)
(From ARM)
ADD
SUB
LDC
TST
SUB
LDC
ADD
SWINE
SUB
LDC
ADD
SWINE
TST
(SUB)
(LDC)
(TST)
(I Fetch
CP
CP
CP
CP
I Fetch
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