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參數(shù)資料
| 型號(hào)： | ARM7TDMI-S |
| 英文描述： | ARM7TDMI-S Microprocessor Core preliminary technical manual 5/00 |
| 中文描述： | 的ARM7TDMI - S微處理器核的初步技術(shù)手冊(cè)5 / 00 |
| 文件頁數(shù)： | 15/184頁 |
| 文件大?。?/td> | 1147K |
| 代理商： | ARM7TDMI-S |
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ARM7TDMI-S Microprocessor Core Technical Manual
August 2001 - Rev. A
Copyright 2000 by LSI Logic Corporation. All rights reserved.
1-1
Chapter 1
Introduction
This chapter introduces the core architecture and shows block, core, and
functional diagrams. It contains the following sections:
Section 1.1, “Introduction”
Section 1.2, “ARM7TDMI-S Architecture”
Section 1.3, “ARM7TDMI-S Core Instruction Set Summary”
Section 1.4, “CoreWare
Program”
1.1 Introduction
This section introduces the overall capabilities of LSI Logic Corporation’s
ARM7TDMI-S core implementation and highlights its features.
1.1.1 General Information
The ARM7TDMI-S architecture is a member of the Advanced RISC
Machines (ARM) family of general-purpose 32-bit microprocessors,
which offer high performance for very low power consumption and price.
The ARM
architecture is based on Reduced Instruction Set Computer
(RISC) principles, and the instruction set and related decode mechanism
are much simpler than those of microprogrammed Complex Instruction
Set Computers. This simplicity results in a high instruction throughput
and impressive real time interrupt response from a small and cost
effective chip.
Pipelining is employed so that all parts of the processing and memory
systems can operate continuously. Typically, while one instruction is
being executed, its successor is being decoded, and a third instruction is
being fetched from memory.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| ARM946E-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM946E-S Microprocessor Core with Cache technical manual 6/01 |
| ARM966E-S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ARM966E-S Microprocessor Core preliminary technical manual 6/01 |
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