參數(shù)資料
型號(hào): ARM7TDMI-S
英文描述: ARM7TDMI-S Microprocessor Core preliminary technical manual 5/00
中文描述: 的ARM7TDMI - S微處理器核的初步技術(shù)手冊(cè)5 / 00
文件頁數(shù): 4/184頁
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代理商: ARM7TDMI-S
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iv
Preface
Rev. A
Copyright 2000 by LSI Logic Corporation. All rights reserved.
Chapter 6,
Debug Interface
, describes the ARM7TDMI-S debug
interface.
Chapter 7,
Instruction Cycle Timing
, provides the instruction cycle
timing for the ARM7TDMI-S core.
Appendix A,
Differences Between the ARM7TDMI-S and the
ARM7TDMI
, describes the differences between the ARM7TDMI-S
and the ARM7TDMI hard macrocell.
Appendix B,
Detailed Debug Operation
, provides extensive detail of
the debug operation of the ARM7TDMI-S core.
Related Publications
ARM7TDMI Microprocessor Core Technical Manual Document No.
DB14-000058-02
ARM Architecture Reference Manual (ARM DDI 0100).
ARM7TDMI Data Sheet (ARM DDI 0029).
IEEE Std. 1149.1- 1990, Standard Test Access Port and Boundary-Scan
Architecture
Conventions Used in This Manual
The first time a word or phrase is defined in this manual, it is italicized.
The word assert means to drive a signal true or active. The word
deassert means to drive a signal false or inactive. Signals that are active
LOW contain a lowercase “n.”
Hexadecimal numbers are indicated by the prefix “0x” —for example,
0x32CF. Binary numbers are indicated by the prefix “0b” —for example,
0b0011.0010.1100.1111.
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