參數(shù)資料
型號(hào): ARM7TDMI-S
英文描述: ARM7TDMI-S Microprocessor Core preliminary technical manual 5/00
中文描述: 的ARM7TDMI - S微處理器核的初步技術(shù)手冊(cè)5 / 00
文件頁(yè)數(shù): 64/184頁(yè)
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代理商: ARM7TDMI-S
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3-14
Programmer’s Model
Rev. A
Copyright 2000 by LSI Logic Corporation. All rights reserved.
SUBS PC,R14_fiq,#4
To disable an FIQ exception from a privileged mode, set the CPSR’s F
flag. When the F flag is clear, the ARM7TDMI-S checks for a LOW level
on the output of the FIQ synchronizer at the end of each instruction.
3.6.4 Interrupt Request (IRQ)
The IRQ (Interrupt Request) exception is a normal interrupt caused by a
LOW level on the nIRQ input. An IRQ exception has a lower priority than
an FIQ exception. It is masked out when an FIQ sequence is entered. To
disable an IRQ exception at any time, set the I bit in the CPSR from a
privileged (non-user) mode.
Irrespective of whether the exception was entered from ARM or Thumb
state, an IRQ handler executes the following instruction to return from the
interrupt:
SUBS PC,R14_irq,#4
3.6.5 Aborts (PABT and DABT)
An abort indicates that the current memory access cannot be completed.
Assertion of the external ABORT input causes the abort exception. The
ARM7TDMI-S checks for the abort exception at the end of memory
access cycles.
There are two types of aborts:
a prefetch abort (PABT) occurs during an instruction prefetch
a data abort (DABT) occurs during a data access
3.6.5.1 Prefetch Aborts
When a prefetch abort occurs, the ARM7TDMI-S marks the prefetched
instruction as invalid, but does not take the exception until the instruction
reaches the execute stage of the pipeline. If the instruction is not
executed—for example, because a branch occurs while it is in the
pipeline—the abort does not take place.
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