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參數(shù)資料
| 型號(hào)： | ARM7TDMI-S |
| 英文描述： | ARM7TDMI-S Microprocessor Core preliminary technical manual 5/00 |
| 中文描述： | 的ARM7TDMI - S微處理器核的初步技術(shù)手冊(cè)5 / 00 |
| 文件頁(yè)數(shù)： | 55/184頁(yè) |
| 文件大?。?/td> | 1147K |
| 代理商： | ARM7TDMI-S |
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Registers
Rev. A
3-5
Copyright 2000 by LSI Logic Corporation. All rights reserved.
Figure 3.3
Register Organization in ARM State
3.5.1.1 Link Register (R14)
R14 is used as the subroutine link register. It receives a copy of R15
when a Branch with Link (BL) instruction is executed. At all other times,
R14 is treated as a general-purpose register. The corresponding banked
registers R14_svc, R14_irq, R14_fiq, R14_abt, and R14_und are
similarly used to hold the return values of R15 when interrupts and
exceptions arise, or when BL instructions are executed within interrupt or
exception routines.
ARM State General Registers and Program Counter
R0
R1
R2
R3
R4
R5
R6
R7
R8
R9
R10
R11
R12
R13
R14
R15 (PC)
R0
R1
R2
R3
R4
R5
R6
R7
R8_fiq
R9_fiq
R10_fiq
R11_fiq
R12_fiq
R13_fiq
R14_fiq
R15 (PC)
R0
R1
R2
R3
R4
R5
R6
R7
R8
R9
R10
R11
R12
R13_svc
R14_svc
R15 (PC)
R0
R1
R2
R3
R4
R5
R6
R7
R8
R9
R10
R11
R12
R13_abt
R14_abt
R15 (PC)
R0
R1
R2
R3
R4
R5
R6
R7
R8
R9
R10
R11
R12
R13_irq
R14_irq
R15 (PC)
R0
R1
R2
R3
R4
R5
R6
R7
R8
R9
R10
R11
R12
R13_und
R14_und
R15 (PC)
System & User
FIQ
Supervisor
Abort
IRQ
Undefined
CPSR
CPSR
SPSR_fiq
CPSR
SPSR_svc
CPSR
SPSR_abt
CPSR
SPSR_irq
CPSR
SPSR_und
ARM State Program Status Registers
= Banked Register
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