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參數(shù)資料
| 型號： | ARM7TDMI-S |
| 英文描述： | ARM7TDMI-S Microprocessor Core preliminary technical manual 5/00 |
| 中文描述： | 的ARM7TDMI - S微處理器核的初步技術(shù)手冊5 / 00 |
| 文件頁數(shù)： | 63/184頁 |
| 文件大?。?/td> | 1147K |
| 代理商： | ARM7TDMI-S |
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Exceptions
Rev. A
3-13
Copyright 2000 by LSI Logic Corporation. All rights reserved.
next instruction regardless of whether the
SWI
was executed in ARM
or Thumb state.
2.
Copies the CPSR into the appropriate SPSR.
3.
Forces the CPSR mode bits to a value which depends on the
exception.
4.
Forces the PC to fetch the next instruction from the relevant
exception vector.
The ARM7TDMI-S can also set the interrupt disable flags to prevent
otherwise unmanageable nestings of exceptions.
Note:
Exceptions are always handled in ARM state. If the proces-
sor is in Thumb state when an exception occurs, it
automatically switches into ARM state when the PC is
loaded with the exception vector address.
3.6.2 Leaving an Exception
When handling of an exception is completed, the exception handler:
1.
Moves the Link Register minus an offset where appropriate to the
PC. (The offset varies depending on the type of exception.)
2.
Copies the SPSR back to the CPSR.
3.
Clears the interrupt disable flags, if they were set on entry.
Note:
The action of restoring the CPSR from the SPSR automat-
ically resets the T bit to the value it held immediately prior
to the exception.
3.6.3 Fast Interrupt Request (FIQ)
The FIQ (Fast Interrupt Request) exception supports data transfers or
channel processes. In ARM state, FIQ mode has eight private registers
to remove the need for register saving (thus minimizing the overhead of
context switching).
Driving nFIQ LOW externally generates an FIQ exception.
Irrespective of whether the exception was entered from ARM or Thumb
state, an FIQ handler executes the following instruction to leave the
interrupt:
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