參數(shù)資料
型號(hào)： R4F2116BG20V
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 20 MHz, MICROCONTROLLER, PBGA176
封裝： 13 X 13 MM, 0.80 MM PITCH, PLASTIC, LFBGA-176
文件頁數(shù)： 392/842頁
文件大?。?/td> 5188K
代理商： R4F2116BG20V
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Section 14 I2C Bus Interface (IIC)
Rev. 1.00 Mar. 02, 2006 Page 411 of 798
REJ09B0255-0100
14.3
Register Descriptions
The I
2C bus interface has the following registers. Registers ICDR and SARX and registers ICMR
and SAR are allocated to the same addresses. Accessible registers differ depending on the ICE bit
in ICCR. When the ICE bit is cleared to 0, SAR and SARX can be accessed, and when the ICE bit
is set to 1, ICMR and ICDR can be accessed. For details on the serial timer control register, see
section 3.2.3, Serial Timer Control Register (STCR).
I2C bus control register (ICCR)
I2C bus status register (ICSR)
I2C bus data register (ICDR)
I2C bus mode register (ICMR)
Slave address register (SAR)
Second slave address register (SARX)
I2C bus extended control register (ICXR)
I2C bus control initialization register (ICRES)*
Note: * ICRES is available only in IIC_0 and IIC_2.
14.3.1
I
2C Bus Data Register (ICDR)
ICDR is an 8-bit readable/writable register that is used as a transmit data register when
transmitting and a receive data register when receiving. ICDR is internally divided into a shift
register (ICDRS), receive buffer (ICDRR), and transmit buffer (ICDRT). Data transfers among
these three registers are performed automatically in accordance with changes in the bus state, and
they affect the status of internal flags such as ICDRE and ICDRF.
In master transmit mode with the I
2C bus format, writing transmit data to ICDR should be
performed after start condition detection. When the start condition is detected, previous write data
is ignored. In slave transmit mode, writing should be performed after the slave addresses match
and the TRS bit is automatically changed to 1.
If the IIC is in transmit mode (TRS = 1) and ICDRT has the next data (the ICDRE flag is 0), data
is transferred automatically from ICDRT to ICDRS, following transmission of one frame of data
using ICDRS. When the ICDRE flag is 1 and the next transmit data writing is waited, data is
transferred automatically from ICDRT to ICDRS by writing to ICDR. If I
2C is in receive mode
(TRS = 0), no data is transferred from ICDRT to ICDRS. Note that data should not be written to
ICDR in receive mode.
相關(guān)PDF資料
PDF描述
R5F21103DFP 16-BIT, FLASH, MICROCONTROLLER, PQFP32
R5F21104FP 16-BIT, FLASH, MICROCONTROLLER, PQFP32
R5F21103DFP 16-BIT, FLASH, MICROCONTROLLER, PQFP32
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參數(shù)描述
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R4F2117VBG 制造商:Renesas Electronics Corporation 功能描述:
R4F2117VBG20V 制造商:Renesas Electronics Corporation 功能描述:
R4F2117VLP 制造商:Renesas Electronics Corporation 功能描述:
R4F2117VTE 制造商:Renesas Electronics Corporation 功能描述:MCU, FLASH, 20MHZ, 3.0 TO 3.6V - Trays
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