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參數(shù)資料
| 型號(hào)： | P8XC591 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | HiRel FPGA, Low-Power 1.0?? CMOS Technology |
| 中文描述： | 單芯片8 - CAN控制器位微控制器 |
| 文件頁數(shù)： | 132/160頁 |
| 文件大?。?/td> | 601K |
| 代理商： | P8XC591 |
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2000 Jul 26
132
Philips Semiconductors
Preliminary Specification
Single-chip 8-bit microcontroller with CAN controller
P8xC591
21.2
Interrupt Enable and Priority Registers
21.2.1
I
NTERRUPT
E
NABLE
R
EGISTER
0 (IEN0)
Logic 0 = interrupt disabled; logic 1 = interrupt enabled.
Table 93
Interrupt Enable Register 0 (address A8H)
Table 94
Description of IEN0 bits
21.2.2
I
NTERRUPT
E
NABLE
R
EGISTER
1 (IEN1)
Logic 0 = interrupt disabled; logic 1 = interrupt enabled.
Table 95
Interrupt Enable Register 1 (address E8H)
Table 96
Description of IEN1 bits
7
6
5
4
3
2
1
0
EA
EAD
ES1
ES0
ET1
EX1
ET0
EX0
BIT
SYMBOL
DESCRIPTION
7
EA
Global enable/disable control
. If bit EA is:
LOW, then no interrupt is enabled.
HIGH, then any individually enabled interrupt will be accepted.
Enable ADC interrupt.
Enable SIO1 (I
2
C) interrupt.
Enable SIO0 (UART) interrupt.
Enable Timer 1 interrupt.
Enable External 1 interrupt / Seconds interrupt.
Enable Timer 0 interrupt.
Enable External 0 interrupt.
6
5
4
3
2
1
0
EAD
ES1
ES0
ET1
EX1
ET0
EX0
7
6
5
4
3
2
1
0
ET2
ECAN
ECM1
ECM0
ECT3
ECT2
ECT1
ECT0
BIT
SYMBOL
DESCRIPTION
7
6
5
4
3
2
1
0
ET2
ECAN
ECM1
ECM0
ECT3
ECT1
ECT1
ECT0
Enable T2 overflow interrupt(s).
Enable CAN interrupt.
Enable T2 comparator 1 interrupt.
Enable T2 comparator 0 interrupt.
Enable T2 capture register 3 interrupt.
Enable T2 capture register 2 interrupt.
Enable T2 capture register 1 interrupt.
Enable T2 capture register 0 interrupt.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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