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參數(shù)資料
| 型號： | IBM21P100BGB |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA304 |
| 封裝： | 31 X 31 MM, HEAT SINK, PLASTIC, BGA-304 |
| 文件頁數(shù)： | 95/140頁 |
| 文件大?。?/td> | 2032K |
| 代理商： | IBM21P100BGB |
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IBM21P100BGB
IBM 133 PCI-X Bridge R1.1
Configuration Registers
Page 50 of 131
ppb11_pcix_regs.fm.03
July 9, 2001
5.2.4.23 Prefetchable Base Upper 32 Bits Register
The Prefetchable Base Upper 32 Bits register specifies the base of the prefetchable memory address range
bits 63:32 and is used in conjunction with the Prefetchable Memory Base register, the Prefetchable Memory
Limit register, and the Prefetchable Limit Upper 32 Bits register to specify a range of 64-bit addresses
supported for prefetchable memory transactions on the PCI Bus. Address bits 19:0 are assumed to be
x‘0 0000’ for the base address.
5.2.4.24 Prefetchable Limit Upper 32 Bits Register
The Prefetchable Limit Upper 32 Bits register specifies the upper address of the prefetchable memory
address range bits 63:32 and is used in conjunction with the Prefetchable Memory Base register, the
Prefetchable Memory Limit register, and the Prefetchable Base Upper 32 Bits register to specify a range of
64-bit addresses supported for prefetchable memory transactions on the PCI Bus. Address bits 19:0 are
assumed tobex‘F FFFF’ for the limit address.
Address Offset
x‘28’
Access
See individual fields
Reset Value
x‘XXXX XXXX’
Prefetchable Base Upper 32 Bits
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Bit(s)
Access
Field Name and Description
31:0
RW
Address bits 63:32 of the base address for the address range of prefetchable memory operations that are
passed from the primary to the secondary PCI bus.
Address Offset
x‘2C’
Access
See individual fields
Reset Value
x‘XXXX XXXX’
Prefetchable Limit Upper 32 Bits
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
Bit(s)
Access
Field Name and Description
31:0
RW
Address bits 63:32 of the limit address for the address range of prefetchable memory operations that are
passed from the primary to the secondary PCI bus.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IBM21P100BGC | PCI BUS CONTROLLER, PBGA304 |
| IBM25403GCX-3JC76C2 | RISC PROCESSOR, PQFP16 |
| IBM25405GP-3BA200C2 | RISC PROCESSOR, PBGA456 |
| IBM25EMPPC603EFG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, PQFP240 |
| IBM25EMPPC603EBG-100 | 32-BIT, 100 MHz, RISC PROCESSOR, CBGA255 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IBM24L5086 | 制造商:AVED MEMORY PRODUCTS 功能描述: 制造商:AVED Memory Products 功能描述: |
| IBM25403GCX-3BC80C2 | 制造商:IBM 功能描述:RISC PROCESSOR, 160 Pin Plastic BGA |
| IBM25403GCX-3JC50C2 | 制造商:IBM 功能描述:403GCX-3JC50C2 |
| IBM25403GCX-3JC66C2 | 制造商:IBM 功能描述: |
| IBM25403GCX3JC76C2 | 制造商:IBM 功能描述: |
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