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參數(shù)資料
| 型號： | ADUC7032BSTZ-88-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 79/120頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 96K FLASH DUAL 48LQFP |
| 標準包裝： | 2,000 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 連通性： | LIN，SPI，UART/USART |
| 外圍設備： | POR，PSM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 9 |
| 程序存儲器容量： | 96KB（48K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1.5K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 數(shù)據(jù)轉換器： | A/D 2x16b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 48-LQFP |
| 包裝： | 帶卷 (TR) |
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ADuC7032-8L
Rev. A | Page 61 of 120
ADuC7032-8L SYSTEM CLOCKS
The ADuC7032-8L integrates a highly flexible clocking system
that can be clocked from one of three sources: an integrated on-
chip precision oscillator, an integrated on-chip low power oscil-
lator, or an external watch crystal. These three options are shown
in Figure 27.
Each of the internal oscillators is divided by four to generate a
clock frequency of 32.768 kHz. The PLL locks onto a multiple
(625) of 32.768 kHz, supplied by either of the internal oscillators
or the external crystal, providing a stable 20.48 MHz clock for
the system. The core can operate at this frequency or at binary
submultiples of it, allowing power saving if peak performance is
not required.
By default, the PLL is driven by the low power oscillator, which
generates a 20.48 MHz clock source. The ARM7TDMI core is
driven by a CD divided clock derived from the output of the
PLL. By default, the CD divider is configured to divide the PLL
output by two, which generates a core clock of 10.24 MHz.
The divide factor can be modified to generate a binary weighted
divider factor from 1 to 128, which can be altered dynamically
by user code.
The ADC is driven by the output of the PLL, divided to give an
ADC clock source of 512 kHz. In low-power mode, the ADC
clock source is switched from the standard 512 kHz to the low
power 131 kHz oscillator.
It should also be noted that the low power oscillator drives both
the watchdog and core wake-up timers through a divide-by-4
circuit. A detailed block diagram of the ADuC7032-8L clocking
system is shown in Figure 27.
SPI
CORE CLOCK
PLL OUTPUT
(20.48MHz)
UART
CORE CLOCK
PRECISION
CLOCK
131kHz
DIV 4
PRECISION
OSCILLATOR
LOW POWER
OSCILLATOR
EXTERNAL
32.768kHz
LOW POWER
131kHz
DIV 4
PLLCON
PLL
FLASH
CONTROLLER
ECLK 2.5MHz
PRECISION
32.768kHz
LOW POWER
32.768kHz
PLL OUTPUT
20.48MHz
CRYSTAL
CIRCUITRY
EXTERNAL CRYSTAL
(OPTIONAL)
PLL LOCK
1
8
ADCMDE
CLOCK
DIVIDER
CORE
CLOCK
1
2CD
MCU
ADC
CLOCK
ADC
HIGH ACCURACY
CALIBRATION
COUNTER
EXTERNAL
32.768kHz
PRECISION
131kHz
LOW POWER
CALIBRATION
COUNTER
LOW POWER
OSCILLATOR
TIMER0
LIFE TIME
CORE CLOCK
EXTERNAL
32.768kHz
PRECISION
32.768kHz
LOW POWER
32.768kHz
GPIO_5
TIMER1
CORE CLOCK
GPIO_8
LOW POWER
32.768kHz
TIMER2
WAKE-UP
CORE CLOCK
LOW POWER
32.768kHz
PRECISION
32.768kHz
EXTERNAL
32.768kHz
WATCHDOG
TIMER3
LOW POWER
32.768kHz
TIMER4
STI
LOW POWER
32.768kHz
CORE CLOCK
LIN H/W
SYNCHRONIZATION
LOW POWER
32.768kHz
PLL OUTPUT
(5MHz)
0
59
86
-0
27
Figure 27. ADuC7032-8L System Clock Generation
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PDF描述 |
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| ADUC7033 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Integrated Precision Battery Sensor For Automotive |
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