- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄378055 > PM6344 (PMC-SIERRA INC) Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 PDF資料下載
參數(shù)資料
| 型號(hào)： | PM6344 |
| 廠(chǎng)商： | PMC-SIERRA INC |
| 元件分類(lèi)： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP128 |
| 封裝： | 20 X 14 MM, PLASTIC, QFP-128 |
| 文件頁(yè)數(shù)： | 96/256頁(yè) |
| 文件大?。?/td> | 1030K |
| 代理商： | PM6344 |
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STANDARD PRODUCT
PMC-Sierra, Inc.
PM6344 EQUAD
PMC-951013
ISSUE 5
QUADRUPLE E1 FRAMER
83
DBCTRL:
The DBCTRL bit is used to pass control of the data bus drivers to the CSB
pin. When the DBCTRL bit is set to logic 1, the CSB pin controls the output
enable for the data bus. While the DBCTRL bit is set, holding the CSB pin
high causes the EQUAD to drive the data bus and holding the CSB pin low
tri-states the data bus. The DBCTRL bit overrides the HIZDATA bit. The
DBCTRL bit only has effect if either the IOTST or PMCTST bit is set. The
DBCTRL bit is used to measure the drive capability of the data bus driver
pads.
IOTST:
The IOTST bit is used to allow normal microprocessor access to the test
registers and control the test mode in each block in the EQUAD for board
level testing. When IOTST is a logic 1, all blocks are held in test mode and
the microprocessor may write to a block's test mode 0 registers to manipulate
the outputs of the block and consequently the device outputs (refer to the
"Test Mode 0 Details" in the "Test Features" section).
HIZIO,HIZDATA:
The HIZIO and HIZDATA bits control the tri-state modes of the EQUAD .
While the HIZIO bit is a logic 1, all output pins of the EQUAD except the data
bus are held in a high-impedance state. The microprocessor interface is still
active. While the HIZDATA bit is a logic 1, the data bus is also held in a high-
impedance state which inhibits microprocessor read cycles.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| PM6344-RI | 制造商:PMC 制造商全稱(chēng):PMC 功能描述:QUADRUPLE E1 FRAMER |
| PM6388 | 制造商:PMC 制造商全稱(chēng):PMC 功能描述:OCTAL E1 FRAMER |
| PM6388RI | 制造商:PMC-Sierra 功能描述: |
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