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參數(shù)資料
| 型號： | PM6344 |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP128 |
| 封裝： | 20 X 14 MM, PLASTIC, QFP-128 |
| 文件頁數(shù)： | 195/256頁 |
| 文件大?。?/td> | 1030K |
| 代理商： | PM6344 |
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STANDARD PRODUCT
PMC-Sierra, Inc.
PM6344 EQUAD
PMC-951013
ISSUE 5
QUADRUPLE E1 FRAMER
182
logic 0, the specific bit value is sourced from the TRAN block
International/National Control register. Depending on the settings of the
TXSAxEN bits, the effective bit rate of the data link may range between 4 bit/s
and 20 kbit/s. TDLSIG[x] is sampled on the rising edge of TDLCLK[x]. Note that
the TDLSIG[x] data is shifted from the corresponding BTPCM[x] data by 2 bits.
12.1 Receive Backplane Interface
Figure 13
- ROHM=0, BRX2RAIL=0, BRXSMFP=0 and BRXCMFP=0
1 2 3 4 5 6 7 8
A B C D
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
A B C D
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
A B C D
Timeslot 31
Timeslot 0
Timeslot 1
Timeslot 16
Timeslot 17
BRCLK
BRFPO[x]
BRPCM[x]
BRSIG[x]
BRFPI
Undefined
Undefined
Undefined
The Receive Backplane is configured to generate 2048 kbit/s, single-rail
formatted data with frame alignment indication. The Receive Backplane Options
register is programmed to BRX2RAIL=0, BRXSMFP=0 and BRXCMFP=0.
The BRFPI input pulse need not exist every frame; only one is required to align
the backplane signals. If no BRFPI pulse has been presented since reset, the
outputs will assume an arbitrary alignment.
If ROHM=0, BRXSMFP=0 and BRXCMFP=1, the BRFPO[x] signal pulses high
only during the first bit of the first frame in the CRC multiframe.
If ROHM=0, BRXSMFP=1 and BRXCMFP=0, the BRFPO[x] signal pulses high
only during the first bit of the frame containing the signaling multiframe alignment
signal.
相關(guān)PDF資料 |
PDF描述 |
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| PM6388 | CONNECTOR |
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參數(shù)描述 |
|---|---|
| PM6344-RI | 制造商:PMC 制造商全稱:PMC 功能描述:QUADRUPLE E1 FRAMER |
| PM6388 | 制造商:PMC 制造商全稱:PMC 功能描述:OCTAL E1 FRAMER |
| PM6388RI | 制造商:PMC-Sierra 功能描述: |
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