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參數(shù)資料
| 型號： | NS32FX164V-25 |
| 廠商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Advanced Imaging/Communication Signal Processors |
| 中文描述： | 16-BIT, 50 MHz, MIXED DSP, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁數(shù)： | 89/102頁 |
| 文件大小： | 1053K |
| 代理商： | NS32FX164V-25 |
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Appendix A: Instruction Formats
NOTATIONS
i
e
Integer Type Field
B
e
00 (Byte)
W
e
01 (Word)
D
e
11 (Double Word)
f
e
Floating-Point Type Field
F
e
1 (Std. Floating: 32 bits)
L
e
0 (Long Floating: 64 bits)
op
e
Operation Code
Valid encodings shown with each format.
gen, gen 1, gen 2
e
General Addressing Mode Field
See Section 2.4.2 for encodings.
reg
e
General Purpose Register Number
cond
e
Condition Code Field
0000
e
EQual: Z
e
1
0001
e
Not Equal: Z
e
0
0010
e
Carry Set: C
e
1
0011
e
Carry Clear: C
e
0
0100
e
Higher: L
e
1
0101
e
Lower or Same: L
e
0
0110
e
Greater Than: N
e
1
0111
e
Less or Equal: N
e
0
1000
e
Flag Set: F
e
1
1001
e
Flag Clear: F
e
0
1010
e
LOwer: L
e
0 and Z
e
0
1011
e
Higher or Same: L
e
1 or Z
e
1
1100
e
Less Than: N
e
0 and Z
e
0
1101
e
Greater or Equal: N
e
1 or Z
e
1
1110
e
(Unconditionally True)
1111
e
(Unconditionally False)
short
e
Short Immediate Value. May contain
quick: Signed 4-bit value, in MOVQ, ADDQ,
CMPQ, ACB
cond: Condition Code (above), in Scond.
areg: CPU Dedicated Register, in LPR, SPR
0000
e
UPSR
0001–0111
e
(Reserved)
1000
e
FP
1001
e
SP
1010
e
SB
1011
e
(Reserved)
1100
e
(Reserved)
1101
e
PSR
1110
e
INTBASE
1111
e
MOD
Options: in String Instructions
U/W
B
T
T
e
Translated
B
e
Backward
U/W
e
00: None
01: While Match
11: Until Match
Configuration bits in SETCFG instruction:
C
M
F
I
7
0
cond
1 0 1 0
Format 0
Bcond
(BR)
7
0
op
0 0 1 0
Format 1
BSR
RET
CXP
RXP
RETT
RETI
SAVE
RESTORE
D0000
D0001
D0010
D0011
D0100
D0101
D0110
D0111
ENTER
EXIT
NOP
WAIT
DIA
FLAG
SVC
BPT
D1000
D1001
D1010
D1011
D1100
D1101
D1110
D1111
15
87
0
gen
short
op
1 1
i
Format 2
ADDQ
CMPQ
SPR
Scond
D000
D001
D010
D011
ACB
MOVQ
LPR
D100
D101
D110
15
87
0
gen
op
1 1 1 1 1
i
Format 3
CXPD
BICPSR
JUMP
BISPSR
Trap (UND) on XXX1, 1000
D0000
D0010
D0100
D0110
ADJSP
JSR
CASE
D1010
D1100
D1110
15
87
0
gen 1
gen 2
op
i
Format 4
ADD
CMP
BIC
ADDC
MOV
OR
D0000
D0001
D0010
D0100
D0101
D0110
SUB
ADDR
AND
SUBC
TBIT
XOR
D1000
D1001
D1010
D1100
D1101
D1110
23
16 15
8 7
0
0 0 0 0 0
short
0
op
i
0 0 0 0 1 1 1 0
89
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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