- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄45353 > MPC823CZT25 (MOTOROLA INC) 32-BIT, RISC PROCESSOR, PBGA256 PDF資料下載
參數(shù)資料
| 型號(hào)： | MPC823CZT25 |
| 廠商： | MOTOROLA INC |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, RISC PROCESSOR, PBGA256 |
| 封裝： | 23 X 23 MM, 1.27 MM PITCH, PLASTIC, BGA-256 |
| 文件頁(yè)數(shù)： | 563/1407頁(yè) |
| 文件大?。?/td> | 13074K |
| 代理商： | MPC823CZT25 |
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PowerPC Architecture Compliance
MOTOROLA
MPC823 USER’S MANUAL
7-11
PPC
ARCHITECTURE
7
COMPLIANCE
7.3.7.3.6 Program Interrupt. The MPC823 cannot generate a floating-point exception type
interrupt. Likewise, an illegal instruction type program interrupt is not generated by the core,
but an implementation-dependent software emulation interrupt is generated instead. A
privileged instruction program interrupt is generated for an on-core valid special-purpose
register (SPR) field or any SPR encoded as an external special register if SPR0 =1 and
MSRPR =1, as well as if you try to execute privileged instruction occurred when MSRPR =1.
See Table 6-11 for details.
7.3.7.3.7 Floating-Point Unavailable Interrupt. The MPC823 cannot generate a
floating-point exception type interrupt. An implementation-dependent software emulation
interrupt will be taken when you try to execute floating-point instruction, regardless of
MSRFP.
7.3.7.3.8 Trace Interrupt. A trace interrupt occurs if MSRSE = 1 and any instruction except
rfi is successfully completed or if MSRBE = 1 and a branch is completed. Notice that the trace
interrupt does not occur after an instruction that causes an interrupt. The monitor/debugger
software must change the vectors of other possible interrupt addresses to single-step these
instructions. If this is unacceptable, other debug features can be used. Refer to
Section 20 Development Capabilities and Interface for more information. The following
registers are set on a trace interrupt:
SRR0—Save/Restore Register 0
Set to the effective address of the instruction following the executed instruction.
SRR1—Save/Restore Register 1
1–4
Set to 0.
10–15
Set to 0.
Other
Loaded from bits 16-31 of the MSR. In the current implementation, Bit 30 of
the SRR1 is never cleared, except by loading a zero value from MSRRI.
MSR—Machine State Register
IP
No change.
ME
No change.
LE
Bits are copied from the ILE.
Other
Set to 0.
Execution resumes at offset x’00D00’ from the base address indicated by MSRIP.
7.3.7.3.9 Floating-Point Assist Interrupt. The floating-point assist interrupt is not
generated by the MPC823. An implementation-dependent software emulation interrupt will
be taken when you try to execute a floating-point instruction.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC823ZT25 | 32-BIT, RISC PROCESSOR, PBGA256 |
| MPC8241LVR200X | 32-BIT, 200 MHz, RISC PROCESSOR, PBGA357 |
| MPC8241LVR166X | 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357 |
| MPC8241LVR266D | 32-BIT, 266 MHz, RISC PROCESSOR, PBGA357 |
| MPC8241LZQ166D | 32-BIT, 166 MHz, RISC PROCESSOR, PBGA357 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC823ELD | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823ELE | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823EPAD | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823EPAK | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
| MPC823ERD | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:MPC823e Mobile Computing Microprocessor |
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