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參數(shù)資料
| 型號： | HC05V7GRS |
| 英文描述： | 68HC05V7 General Release Specification |
| 中文描述： | 68HC05V7一般版本規(guī)范 |
| 文件頁數(shù)： | 60/170頁 |
| 文件大?。?/td> | 980K |
| 代理商： | HC05V7GRS |
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MOTOROLA
Page 46
SECTION 7: POWER SUPPLY AND REGULATION
MC68HC05V7 Specification Rev. 1.0
secondary regulator is always enabled (regardless of the mask option selection) but
consumes significantly less power than the primary regulator. The secondary regulator will
provide sufficient voltage to the control logic provided V
BATT
remains above the minimum
voltage.
7.2
MISCELLANEOUS REGISTER
The software power supply management functions are performed through the
MISCELLANEOUS register located at $002F. Although the OCE bit of the
MISCELLANEOUS register is unrelated to the power supply, it will be described here.
Figure 7-1: Miscellaneous Register
7.2.1
IGNS - Ignition status bit
This is a read only status bit which indicates the state of the V
IGN
pin.
0 - The V
IGN
pin is less than the V
IL
level for this pin.
1 - The V
IGN
pin is greater than the V
IH
level for this pin.
WARNING: There is not hysteresis or hardware debounce on the V
IGN
pin and hence, in
the state of this bit. This bit cannot be read unless the Regulator option is enabled.
See
17.3 DC ELECTRICAL CHARACTERISTICS
for V
IH
and V
IL
levels.
7.2.2
OCE - Output compare enable
This bit controls the function of the PB6 pin.
0 - PB6 functions as a normal I/O pin.
1 - PB6 becomes the TCMP output pin for the 16-bit timer.
See SECTION 11 16-BIT TIMER for a description of the TCMP function.
Reset clears this bit.
7.2.3
PDC - Power Down Control
This bit controls the internal primary voltage regulator.
0 - Disables the internal primary voltage regulator.
1 - Enables the internal primary voltage regulator.
IGNS
MISCELLANEOUS REGISTER
$002F
W
R
PDC
UNIMPLEMENTED
READ
WRITE
ADDR
1
0
2
3
4
5
6
7
REGISTER
0
OCE
0
0
0
-
0
-
-
-
-
-
-
reset
0
F
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n
.
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