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參數(shù)資料
| 型號(hào)： | HC05V7GRS |
| 英文描述： | 68HC05V7 General Release Specification |
| 中文描述： | 68HC05V7一般版本規(guī)范 |
| 文件頁數(shù)： | 155/170頁 |
| 文件大?。?/td> | 980K |
| 代理商： | HC05V7GRS |
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SECTION 17: ELECTRICAL SPECIFICATIONS
MOTOROLA
Page 141
17.4
REGULATOR ELECTRICAL CHARACTERISTICS
(V
BATT
= 12 Vdc
±
10%, V
SS
= 0 Vdc, T
A
= -40
°
C to +85
°
C, unless otherwise noted)
Notes: (All values shown reflect average measurements.)
1. Maximum voltage of 26.5V for 5 minutes only. If V
BATT
exceeds V
BATTMAX
, V
DD
may deviate from min/max limits.
2. Guaranteed by design. Not tested in productions tests.
3. This is the available current out of the V
DD
pin for off chip usage.
4. This transient may be disruptive but will not be destructive.
5. Total regulator load of 20mA. Lighter load currents result in lower V
DIFF
.
* max I
DD
of 20mA at V
DD
=3.5V.
Symbol
Characteristic
Min
Max
Units
V
16
V
BATT
Input Voltage
1
8
V
40
V
BATTMAX
Maximum Input Voltage transient amplitude
2,4
26.5
mS
200
V
BATTDUR
Maximum Input Voltage transient duration
2,4
--
uA
TBD
I
BIAS
Input Bias Current
TBD
uVrms
TBD
V
N
Output Noise Voltage
2
-
dB
65
RR
Ripple Rejection Ratio
2
-
V
2.5
V
DIFF
Input - Output Differential Voltage
5
V
BATT
to V
DD
with V
BATT
< min.
1.5*
mA
95
I
SHORT
Short Circuit Current Limit
75
mV/
°
C
TBD
T
c
Temperature Coefficient
2
-
mA
20
I
O
Output Current
3
-
V
5.25
V
DD
Output Voltage
4.75
mV
50
V
LINEREG
Line regulation
-
mV
50
V
LOADREG
Load regulation at 20mA
-
NOTES:
1. All values shown reflect average measurements.
2. Typical values at midpoint of voltage range, 25
°
C only.
3. Run (Operating) I
DD
, Wait I
DD
: Measured using external square wave clock source to OSC1 (f
OSC
= 4.2 MHz), all inputs
0.2 VDC from rail; no DC loads, less than 50 pF on all outputs, C
L
= 20 pF on OSC2.
4. Wait, Stop I
DD
: All ports configured as inputs, V
IL
= 0.2 Vdc, V
IH
= V
DD
-0.2 Vdc.
5. Stop I
DD
measured with OSC1 = V
SS
.
6. Wait I
DD
is affected linearly by the OSC2 capacitance.
7. Total
* Not Tested.
V
DD
slew rate rising *
0.1
—
SVDDR
V/
μ
s
—
V
DD
slew rate falling*
0.05
—
SVDDF
V/
μ
s
—
POR Reset Voltage *
100
—
VPOR
mV
—
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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