參數資料
型號: AMD-751
廠商: Advanced Micro Devices, Inc.
英文描述: System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統總線、系統存儲器控制器、AGP控制器和PCI總線控制器)
中文描述: 系統總線,系統內存控制器,AGP控制器和PCI總線控制器(系統總線,系統存儲器控制器,AGP接口控制器和的PCI總線控制器)
文件頁數: 44/236頁
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代理商: AMD-751
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22
Signal Descriptions
Chapter 4
AMD-751
System Controller Data Sheet
21910D
August 1999
Preliminary Information
4.2
PCI Interface Signals
4.2.1
AD[31:0] (PCI Address/Data Bus)
Bidirectional
Summary
The AD[31:0] bus contains the standard, multiplexed PCI
address and data lines. AD[31:0] contains a physical address
during the first clock of a PCI transaction, and data during
subsequent clocks. The address is driven when FRAME# is
asserted, and data is driven or received in subsequent cycles.
When the AMD-751 system controller is the PCI initiator, these
lines are outputs during the address and write data phases of a
transaction, and inputs during the read data phases.
When the AMD-751 is the PCI target, these lines are inputs
during the address and write data phases of a transaction, and
outputs during the read data phases.
Driven, Sampled, and
Floated
As Outputs:
As an initiator, the AMD-751 system controller
drives AD[31:0] with a valid address off the first rising edge of
PCLK after it becomes the PCI bus master. During the first
clock that FRAME# is asserted, AD[31:0] contains the address.
During subsequent clocks, AD[31:0] contains data.
As Inputs:
The AMD-751 system controller samples AD[31:0] on
the rising edge of PCLK. During the first clock after FRAME#
is asserted, the AMD-751 loads the bus contents into its
internal address register. On each subsequent clock in which
both TRDY# and IRDY# are asserted, AD[31:0] loads data into
its data FIFO.
AD[31:0] is floated for one clock in between the address phase
and the data phase of a read transfer. AD[31:0] is also floated
during RESET# and when there is no initiator driving the bus.
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