參數(shù)資料
型號(hào): AMD-751
廠商: Advanced Micro Devices, Inc.
英文描述: System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲(chǔ)器控制器、AGP控制器和PCI總線控制器)
中文描述: 系統(tǒng)總線,系統(tǒng)內(nèi)存控制器,AGP控制器和PCI總線控制器(系統(tǒng)總線,系統(tǒng)存儲(chǔ)器控制器,AGP接口控制器和的PCI總線控制器)
文件頁數(shù): 170/236頁
文件大小: 3578K
代理商: AMD-751
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148
Configuration Registers
Chapter 7
AMD-751
System Controller Data Sheet
21910D
August 1999
Preliminary Information
Bit 17
Stop Grant Disconnect Enable (RW)
0
= No disconnect after a Stop Grant special cycle (default)
1
= Disconnect after a Stop Grant special cycle
Bits 16
14
Probe Limit (RW)
This field is set by the BIOS firmware with the maximum
probes that the processor can handle.
000 = 1 probe (default)
001 = 2 probes
010 = 3 probes
.
.
111 = 8 probes
Bits 13
10
Ack Limit (RO)
BIOS firmware reads this field to determine how many
outstanding
un-acked
AMD Athlon system bus commands can be sent to
the AMD-751 system controller.
0000= 1 un-acked commands
0001= 2 un-acked commands
0010= 3 un-acked commands
0011= 4 un-acked commands (default)
.
.
.
1111= 16 un-acked commands
Bit 9
Bypass Mode Enable (RW)
When set, the AMD-751 allows low-latency
accesses to memory. The low-latency access
bypasses
internal FIFOs
and arbiters when no PCI or APCI operations are pending. This mode is
valid for use in AMD Athlon processor systems only.
Note:
Bypass mode is available in Revision C and later of the AMD-751
system controller. In previous revisions, this bit was used as the RIH
enable control. RIH probes are always disabled.
Bits 8
7
DC Out Delay (RO)
This field specifies the number of system (normally
100-MHz) clock cycles from a processor read command and the start of
data.
00
01
10
11
= Reserved
= 1 cycles
= 2 cycles
= 3 cycles
相關(guān)PDF資料
PDF描述
AMD-756 Peripheral Bus Controller(外圍總線控制器)
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