- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄366557 > AMD-751 (Advanced Micro Devices, Inc.) System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲器控制器、AGP控制器和PCI總線控制器) PDF資料下載
參數(shù)資料
| 型號： | AMD-751 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲器控制器、AGP控制器和PCI總線控制器) |
| 中文描述： | 系統(tǒng)總線，系統(tǒng)內(nèi)存控制器，AGP控制器和PCI總線控制器（系統(tǒng)總線，系統(tǒng)存儲器控制器，AGP接口控制器和的PCI總線控制器） |
| 文件頁數(shù)： | 132/236頁 |
| 文件大?。?/td> | 3578K |
| 代理商： | AMD-751 |
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110
Functional Operation
Chapter 5
AMD-751
System Controller Data Sheet
21910D
—
August 1999
Preliminary Information
5.7
Phase Locked Loop (PLL) Features
The phase locked loop (PLL) has the following specifications:
n
Peripheral clock (PCLK) operates at 66 MHz.
AGP 2x clock (AGP2xCLK) operates at 133 MHz.
Core clock (CCLK) can be switched between 100 MHz and
66MHz, as defined by an input pin at reset. The core clock
must be an integral multiple of 33 MHz.
The two clocks (PCLK and CCLK) must have a common
edge.
n
n
n
PLL Clock Outputs
The PLL has two output clocks that are distributed throughout
the AMD-751. The peripheral clock, which runs at 66 MHz, is
used by all the sequencers and logic controlling the peripheral
buses (PCI and AGP). The standard PCI logic runs internally at
66 MHz. The external bus operates at half that speed, and the
conversion is done with clock-enable logic at the bus interface.
In addition, the AGP logic gets the 133-MHz clock it needs for
the double-pumped logic. Every rising edge of the AGP 2x clock
has to align with an edge of the peripheral clock (66 MHz).
The core clock is distributed throughout the AMD-751. It runs
either at 100 MHz or 66 MHz, depending on the system board
and external configuration. The pin that defines which of these
frequencies to use is static and must not change during
operation.
The PLL enables the two clocks (core clock and peripheral
clock) to have a common rising edge. If the clock frequencies
are 66 MHz for the peripheral and 100-MHz for the core, there is
a common rising edge every three core clocks and every two
peripheral clocks.
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