參數(shù)資料
型號(hào)： AMD-751
廠商： Advanced Micro Devices, Inc.
英文描述： System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲(chǔ)器控制器、AGP控制器和PCI總線控制器)
中文描述： 系統(tǒng)總線，系統(tǒng)內(nèi)存控制器，AGP控制器和PCI總線控制器（系統(tǒng)總線，系統(tǒng)存儲(chǔ)器控制器，AGP接口控制器和的PCI總線控制器）
文件頁(yè)數(shù)： 176/236頁(yè)
文件大小： 3578K
代理商： AMD-751
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154
Configuration Registers
Chapter 7
AMD-751
System Controller Data Sheet
21910D
—
August 1999
Preliminary Information
Bit 1
Enable APCI Chaining
—
This bit allows chaining of back-to-back write
operations to APCI (from the processor). Only sequencially-addressed
write transactions that do not cross 4-Kbyte page boundaries can be
combined into one bus burst transfer (chaining).
Bit 0
Enable PCI Chaining
—
This bit allows chaining of back-to-back write
operations to PCI (from the processor). Only sequencially-addressed write
transactions that do not cross 4-Kbyte page boundaries can be combined
into one bus burst transfer (chaining).
Note:
Enable APCI chaining and enable PCI chaining bits are available on the
AMD-751 system controller Revision C and later. In previous revisions,
these bits are read-only and always read 0.
Bits 15
–
8
AGP VGA BIOS Address (RW)
—
This field indicates the corresponding
16-Kbyte segment or segments that contains the VGA BIOS on the AGP
bus. The range of bit settings are as follows:
Bit 0 = address range 0xC0000h
–
0xC3FFFh
Bit 1 = address range 0xC4000h
–
0xC7FFFh
Bit 3 = address range 0xC8000h
–
0xCBFFFh
Bit 4 = address range 0xCC000h
–
0xCFFFFh
Bit 5 = address range 0xD0000h
–
0xD3FFFh
Bit 6 = address range 0xD4000h
–
0xD7FFFh
Bit 7 = address range 0xD8000h
–
0xDBFFFh
Bit 8 = address range 0xDC000h
–
0xDFFFFh
Each RW bit determines if accesses in the respective address range are
forwarded from the primary to the secondary PCI bus. When set, these bits
indicate that the corresponding segment (16 Kbytes) should be mapped to
the AGP PCI (secondary) bus. One or more of these bits should be set if
the AGP graphics card has a BIOS.
0=Do not forward (default)
1=Forward
Bits 7
–
2
Reserved (always reads 0)
PCI and APCI Chaining Register
Bit 7
Device 0
Offset 86h
Bit 0
Chaining Enable
0
6
5
4
3
2
1
Reserved
Reset
0
0
0
0
0
0
0
AGP VGA BIOS Mask Register
Bit 7
DC
Reset
0
Device 0
Offset 87h
Bit 0
C0
6
5
4
3
2
1
D8
0
D4
0
D0
0
CC
0
C8
0
C4
0
0
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PDF描述
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參數(shù)描述
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