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參數(shù)資料
| 型號： | AMD-751 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲器控制器、AGP控制器和PCI總線控制器) |
| 中文描述： | 系統(tǒng)總線，系統(tǒng)內(nèi)存控制器，AGP控制器和PCI總線控制器（系統(tǒng)總線，系統(tǒng)存儲器控制器，AGP接口控制器和的PCI總線控制器） |
| 文件頁數(shù)： | 32/236頁 |
| 文件大?。?/td> | 3578K |
| 代理商： | AMD-751 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁當(dāng)前第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁
10
Overview
Chapter 2
AMD-751
System Controller Data Sheet
21910D
—
August 1999
Preliminary Information
write-and-invalidate (MWI), maximize data throughput. The
AMD-751 system controller employs a variety of techniques to
minimize PCI initiator read latency and DRAM utilization. The
combination of these features allows a PCI initiator to achieve
the full 133-Mbyte burst transfer rate. In addition, the
AMD-751 contains a PCI arbiter. See Chapter 5,
“
Functional
Operation
”
starting on page 45 for more information.
2.1.4
Accelerated Graphics Port (AGP)
The accelerated graphics port (AGP) is an alternate interface
bus for a computer system. The AGP provides a point-to-point
link between a graphics controller and the memory controller.
This additional pathway to memory removes 3D graphics traffic
from the PCI bus and provides a special access path to main
memory, allowing it to function as part of graphics memory and
reducing the amount of memory required on the graphics
adapter. Typically, the section of main memory allocated for
the AGP adapter would then be used to hold
‘
textures
’
,
improving the realism of 3D images.
The AGP bus is essentially an expansion of the standard PCI
local bus containing additional sideband signals and
commands. The three primary enhancements to PCI include
pipelined memory requests, separate address and data buses,
and double-pumped (2x) AC timing mode, in which data is
transferred on both edges of the AGP clock. Double-pumping
enables effective transfer rates as high as 133 MHz, generating
an effective data transfer rate of up to 533 Mbytes/second.
The AGP bus supports PCI as well as AGP transfers. As usual,
the A_FRAME# signal indicates PCI transfers, while a new
signal, PIPE#, is used to signify AGP transfers. To avoid
confusion in this document, the system-wide PCI bus is
referred to as the primary PCI bus, and the PCI
implementation on the AGP bus is referred to as the secondary
PCI bus or A-PCI.
The AMD-751 implements an AGP 1.0-compliant interface,
which provides a 32-bit-wide data path operating at either 66
MHz or 133 MHz. The AMD-751 can queue 16 outstanding AGP
transactions. See Chapter 5,
“
Functional Operation
”
starting
on page 45 for more information.
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