- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄366557 > AMD-751 (Advanced Micro Devices, Inc.) System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲器控制器、AGP控制器和PCI總線控制器) PDF資料下載
參數(shù)資料
| 型號： | AMD-751 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | System Bus, System Memory Controller, AGP Controller, and PCI Bus Controller(系統(tǒng)總線、系統(tǒng)存儲器控制器、AGP控制器和PCI總線控制器) |
| 中文描述： | 系統(tǒng)總線，系統(tǒng)內(nèi)存控制器，AGP控制器和PCI總線控制器（系統(tǒng)總線，系統(tǒng)存儲器控制器，AGP接口控制器和的PCI總線控制器） |
| 文件頁數(shù)： | 166/236頁 |
| 文件大?。?/td> | 3578K |
| 代理商： | AMD-751 |
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144
Configuration Registers
Chapter 7
AMD-751
System Controller Data Sheet
21910D
—
August 1999
Preliminary Information
Bits 6
–
4
TRAS Value (RW)
—
These bits specify the minimum bank (SRAS[2:0]#)
active time.
000 = 2 cycles (default)
001 = 3 cycles
010 = 4 cycles
011 = 5 cycles
100 = 6 cycles
101 = 7 cycles (recommended safe configuration)
110 = Reserved
111 = Reserved
Bits 3
–
2
TCL SDRAM SCAS Latency Value (RW)
—
These bits specify the delay from
SCAS[2:0]# to data valid.
00
01
10
11
= 3 cycle (default) (recommended safe configuration)
= 2 cycles
= Reserved
= 4 cycles
Bits 1
–
0
TRCD SRAS to SCAS Latency Value (RW)
—
These bits specify the delay from the
activation of a bank to the time that a read or write command is accepted.
00
01
10
11
= 1 cycle (default)
= 2 cycles
= 3 cycles (recommended safe configuration)
= 4 cycles
Bits 15
–
9
Reserved (always reads 0)
Bit 8
Idle Cycle Limit [2] (RW)
—
This bit, along with those described on page 143,
specify the number of idle cycles to wait before precharging an idle bank.
Bits 7
–
6
SDRAM Address Bus B and ClkOut DRV (RW)
—
This bit specifies driver strength
selection for the SDRAM MAdB and clock signals.
00
01
10
= Light Load
—
One single-sided DIMM
= Medium Light Load
—
Not used
= Medium Heavy Load
—
Two single-sided DIMMs or
one double-sided DIMM
= Heavy Load
—
Two double-sided DIMMs
11
DRAM CS Driver Strength Register
Bit 15
14
13
Device 0
4
Address Bus A
DRV
0
Offset 57h
–
56h
2
Controls
DRV
0
0
12
11
10
9
8
7
6
5
3
1
Bit 0
Reserved
ICL[2] Address Bus B
DRV
DQM
DRV
Reset
0
0
0
0
0
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AMD-756 | Peripheral Bus Controller(外圍總線控制器) |
| AMD ATHLON | 32-Bit Microprocessor with 3D Multimedia Performance and Digital Video(32位微處理器帶3D多媒體性能和數(shù)字視頻) |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AMD-751AC | 制造商:Advanced Micro Devices 功能描述:SYSTEM CONTROLLER, 492 Pin, BGA |
| AMD-756 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:AMD-756? Peripheral Bus Controller Revision Guide |
| AMD-756AC\T | 制造商:Advanced Micro Devices 功能描述: |
| AMD-760 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:AMD-760 - AMD-760 MPX Chipset Overview |
| AMD-760MP | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:AMD-760 MP - AMD-760 MP Chipset Overview |
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