參數(shù)資料
型號(hào)： UJA1061
廠商： NXP Semiconductors N.V.
英文描述： Low speed CAN/LIN system basis chip
中文描述： 低高速CAN / LIN系統(tǒng)基礎(chǔ)芯片
文件頁(yè)數(shù)： 73/81頁(yè)
文件大?。?/td> 323K
代理商： UJA1061
2004 Mar 22
73
Philips Semiconductors
Objective specification
Low speed CAN/LIN system basis chip
UJA1061
Notes
1.
t
bit
= selected bit time, depends on LSC bits 50 or 96
μ
s (20 or 10.4 kbit/s respectively); bus load conditions
(C
bus
/R
bus
): 1 nF/1 k
; 6.8 nF/660
; 10 nF/500
; see Fig.18.
2.
3.
Interrupt output (pin INTN)
t
INTNH
interrupt release
after SPI has read out the interrupt
register
2
5
μ
s
Oscillator
f
OSC
oscillator frequency
460.8
512
563.2
kHz
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
δ
1,
δ
3
t
2
×
t
bit
------------------------------
=
δ
2,
δ
4
t
×
t
bit
------2
=
mce635
R1
V2
+
5 V
C1
20
CANL
22
CANH
RXDC
GND
BAT42
32
BAT14
27
20 pF
21
23
UJA1061
14
TXDC
13
C2
R1
C1
C
Fig.15 Timing test circuit for CAN-transceiver.
相關(guān)PDF資料
PDF描述
UJA1065 High-speed CAN/LIN fail-safe system basis chip
UL631H256 SimtekLow Voltage SoftStore 32K x 8 nvSRAM
UL631H256S2C35 SimtekLow Voltage SoftStore 32K x 8 nvSRAM
UL631H256S2C35G1 SimtekLow Voltage SoftStore 32K x 8 nvSRAM
UL631H256S2C45 SimtekLow Voltage SoftStore 32K x 8 nvSRAM
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參數(shù)描述
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