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參數(shù)資料
| 型號(hào)： | MB90V560CR |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 8 MHz, MICROCONTROLLER, CPGA256 |
| 封裝： | PGA-256 |
| 文件頁(yè)數(shù)： | 331/616頁(yè) |
| 文件大?。?/td> | 15240K |
| 代理商： | MB90V560CR |
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381
14.4 DTP/External Interrupt Circuit Registers
Reference:
When the extended intelligent I/O service (EI2OS) is activated as a DTP function, the
corresponding external interrupt request flag bit (ER7 to ER0) is cleared to "0" when the
transfer of one piece of data is completed.
Note:
When setting an external interrupt request flag bit (ER7 to ER0) to "0", be sure to set the bit
from which "1" is read by software to "0". If an external interrupt request flag bit (ER7 to
ER0) is set to "1" by hardware when setting it to "0", it will be cleared to "0".
bit11
ER3:
External
interrupt
request flag bit
This bit is a flag that requests an interrupt.
This bit is set to "1" when the level or edge signal set in the external
interrupt request detection condition setting bit (LB3, LA3) of the request
level setting register (ELVR) is detected in the external interrupt input
pin (INT3).
When this bit is set to "1" while the external interrupt request enable bit
(EN3) of the DTP/external interrupt enable register (ENIR) is set to "1",
an interrupt request is output.
When this bit is "0", the interrupt request is cleared.
When this bit is "1", operation is not affected.
bit10
ER2:
This bit is a flag that requests an interrupt.
This bit is set to "1" when the level or edge signal set in the external
interrupt request detection condition setting bit (LB2, LA2) of the request
level setting register (ELVR) is detected in the external interrupt input
pin (INT2).
When this bit is set to "1" while the external interrupt request enable bit
(EN2) of the DTP/external interrupt enable register (ENIR) is set to "1",
an interrupt request is output.
When this bit is "0", the interrupt request is cleared.
When this bit is "1", operation is not affected.
bit9
ER1:
This bit is a flag that requests an interrupt.
This bit is set to "1" when the level or edge signal set in the external
interrupt request detection condition setting bit (LB1, LA1) of the request
level setting register (ELVR) is detected in the external interrupt input
pin (INT1).
When this bit is set to "1" while the external interrupt request enable bit
(EN1) of the DTP/external interrupt enable register (ENIR) is set to "1",
an interrupt request is output.
When this bit is "0", the interrupt request is cleared.
When this bit is "1", operation is not affected.
bit8
ER0:
This bit is a flag that requests an interrupt.
This bit is set to "1" when the level or edge signal set in the external
interrupt request detection condition setting bit (LB0, LA0) of the request
level setting register (ELVR) is detected in the external interrupt input
pin (INT0).
When this bit is set to "1" while the external interrupt request enable bit
(EN0) of the DTP/external interrupt enable register (ENIR) is set to "1",
an interrupt request is output.
When this bit is "0", the interrupt request is cleared.
When this bit is "1", operation is not affected.
Table 14.4-1 Function Description of Each Bit of the DTP/Interrupt Cause Register (EIRR) (Continued)
Bit name
Function
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB90V590ACR | 16-BIT, 16 MHz, MICROCONTROLLER, CPGA256 |
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| MB91103 | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PQFP160 |
| MB91107PFV-G | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP120 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MB9100-100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
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