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參數(shù)資料
| 型號(hào)： | MB90V560CR |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, 8 MHz, MICROCONTROLLER, CPGA256 |
| 封裝： | PGA-256 |
| 文件頁數(shù)： | 19/616頁 |
| 文件大?。?/td> | 15240K |
| 代理商： | MB90V560CR |
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5.3 Low Power Consumption Mode Control Register (LPMCR)
Table 5.3-1 Function Description of Each Bit of the Low Power Consumption Mode Control Register
(LPMCR)
Bit name
Function
bit 7
STP:
Stop bit
This bit selects the stop mode.
When this bit is set to "1", the microcontroller enters stop mode.
When this bit is set to "0", there is no effect on operation.
An external reset or the output of a hardware interrupt resets this bit to "0".
The read value of this bit is "0".
bit 6
SLP:
Sleep bit
This bit selects sleep mode.
When this bit is set to "1", the microcontroller enters sleep mode.
When this bit is set to "0", there is no effect on operation.
An external reset or the output of a hardware interrupt resets this bit to "0".
The read value of this bit is "0".
bit 5
SPL:
Pin state setting
bit valid in
timebase timer
mode or stop
mode)
This bit selects a terminal status in timebase timer mode or stop mode.
When this bit is set to "0", an I/O pin has a retained level.
When this bit is set to "1", an I/O pin has high impedance.
An external reset resets this bit to "0".
bit 4
RST:
Internal reset
signal generation
bit
This bit selects an internal reset.
When this bit is set to "0", an internal reset signal of three machine cycles is
generated.
When this bit is set to "1", there is no effect on operation.
The read value of this bit is "1".
bit 3
TMD:
Timebase timer
mode bit
This bit selects the switching to timebase timer mode.
When this bit is set to "0", the microcontroller enters timebase timer mode.
When this bit is set to "1", there is no effect on operation.
An external reset or the output of a timebase timer interrupt initializes this bit
to "1".
The read value of this bit is "1".
bit 2
bit 1
CG1, CG0:
CPU halt clock
pulses selection
bits
These bits set the number of CPU halt clock pulses in CPU intermittent
operation mode.
The clock supplied to the CPU is stopped for the specified number of clock
cycles every time after an instruction is executed.
These bits select one of the four clock pulses.
A reset initializes these bits to "00B".
bit 0
RESV:
Reserved bit
This bit must be set to "0".
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB90V590ACR | 16-BIT, 16 MHz, MICROCONTROLLER, CPGA256 |
| MB91101APF | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100 |
| MB91101PF-G-BND-R | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP100 |
| MB91103 | 32-BIT, 25 MHz, RISC MICROCONTROLLER, PQFP160 |
| MB91107PFV-G | 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP120 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB-910 | 制造商:Circuit Test 功能描述:BREADBOARD WIRING KIT - 350 PCS |
| MB9100100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB9100-100 | 制造商:COM/DUO 功能描述:FAN 4-6WKS |
| MB91101 | 制造商:Panasonic Industrial Company 功能描述:IC |
| MB91101A | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit RISC Microcontroller |
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