參數(shù)資料
型號： ISP1761
廠商： NXP Semiconductors N.V.
英文描述： Hi-Speed Universal Serial Bus On-The-Go controller
中文描述： 高速通用串行總線和On - The - Go控制器
文件頁數(shù)： 138/158頁
文件大?。?/td> 724K
代理商： ISP1761
9397 750 13258
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 12 January 2005
138 of 158
Philips Semiconductors
ISP1761
Hi-Speed USB OTG controller
15.1.2.2
Single cycle: DMA write
t
w14
t
a34
t
a44
RD_N pulse width
DREQ deassertion time after RD_N assertion
DACK deassertion to next DREQ assertion time
t
d14
11
-
-
-
56
ns
ns
ns
Table 169: DMA read (single cycle)
…continued
V
CC(I/O)
= 3.3 V to 3.6 V; T
amb
=
40
°
C to +85
°
C; unless otherwise specified.
Symbol
Parameter
Min
Max
Unit
DREQ and DACK are active HIGH.
Fig 24. DMA write (single cycle)
Table 170: DMA write (single cycle)
V
CC(I/O)
= 1.65 V to 1.95 V; T
amb
=
40
°
C to +85
°
C; unless otherwise specified.
Symbol
Parameter
t
a15
DACK assertion time after DREQ assertion
t
a25
WR_N assertion time after DACK assertion
t
h15
data hold time after WR_N deassertion
t
h25
DACK hold time after WR_N deassertion
t
su15
data setup time before WR_N deassertion
t
a35
DREQ deassertion time after WR_N assertion
t
cy15
last DACK strobe deassertion to next DREQ
assertion time
t
w15
WR_N pulse width
Min
0
1
3
0
5.5
22
82
Max
-
-
-
-
-
-
-
Unit
ns
ns
ns
ns
ns
ns
ns
22
-
ns
Table 171: DMA write (single cycle)
V
CC(I/O)
= 3.3 V to 3.6 V; T
amb
=
40
°
C to +85
°
C; unless otherwise specified.
Symbol
Parameter
t
a15
DACK assertion time after DREQ assertion
t
a25
WR_N assertion time after DACK assertion
t
h15
data hold time after WR_N deassertion
t
h25
DACK hold time after WR_N deassertion
t
su15
data setup time before WR_N deassertion
Min
0
1
2
0
5.5
Max
-
-
-
-
-
Unit
ns
ns
ns
ns
ns
004aaa525
data
DATA
data 1
DREQ
WR_N
DACK
t
a15
t
a25
t
h15
t
h25
t
su15
t
a35
t
cy15
t
w15
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PDF描述
ISP1761BE Hi-Speed Universal Serial Bus On-The-Go controller
ISP1761ET Hi-Speed Universal Serial Bus On-The-Go controller
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