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參數(shù)資料
| 型號： | DSP1627 |
| 英文描述： | TVS 400W 6.5V BIDIRECT SMA |
| 中文描述： | DSP1627數(shù)字信號處理器 |
| 文件頁數(shù)： | 60/154頁 |
| 文件大?。?/td> | 2365K |
| 代理商： | DSP1627 |
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Data Sheet
March 2000
DSP1627 Digital Signal Processor
60
Lucent Technologies Inc.
5 Software Architecture
(continued)
NI Field
Number of instructions to be loaded into the cache. Zero
implies redo operation.
K Field
Number of times the NI instructions in cache are to be
executed. Zero specifies use of value in
cloop
register.
JA Field
12-bit jump address.
R/W Field
A zero specifies a write, *(O) = DR.
A one specifies a read, DR = *(O).
Table 56. F3 Field
Specifies the operation in an F3 ALU instruction.
Table 57. SRC2 Field
Specifies operands in an F3 ALU instruction.
Note: xx encodes the auxiliary register to be used. 00 (ar0), 01(ar1),
10 (ar2), or 11(ar3).
F3
1000
1001
1010
1011
1101
1110
1111
Operation
aD = aS[h, l]
aD = aS[h, l]
aS[h, l]
aS[h, l]
aD = aS[h, l]
aD = aS[h, l]
aD = aS[h, l]
|
^
&
–
+
&
–
{aT, IM16, p}
{aT, IM16, p}
{aT, IM16, p}
{aT, IM16, p}
{aT, IM16, p}
{aT, IM16, p}
{aT, IM16, p}
SRC2
00
10
01
11
Operands
aSl, IM16
aSh, IM16
aS, aT
aS, p
Table 58. BMU Encodings
F4
0000
0001
0000
0001
1000
1001
1000
1001
1100
1101
1100
1101
0000
0001
1110
0010
1110
0010
1110
1010
0111
0111
AR
00xx
00xx
10xx
10xx
0000
0000
1000
1000
0000
0000
1000
1000
1100
11xx
0000
00xx
0100
01xx
1000
10xx
0000
0001
Operation
aD = aS >> arM
aD = aS << arM
aD = aS >>> arM
aD = aS <<< arM
aD = aS >> aS
aD = aS << aS
aD = aS >>> aS
aD = aS <<< aS
aD = aS >> IM16
aD = aS << IM16
aD = aS >>> IM16
aD = aS <<< IM16
aD = exp(aS)
aD = norm(aS, arM)
aD = extracts(aS, IM16)
aD = extracts(aS, arM)
aD = extractz(aS, IM16)
aD = extractz(aS, arM)
aD = insert(aS, IM16)
aD = insert(aS, arM)
aD = aS:aa0
aD = aS:aa1
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