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參數(shù)資料
| 型號(hào)： | DSP1627 |
| 英文描述： | TVS 400W 6.5V BIDIRECT SMA |
| 中文描述： | DSP1627數(shù)字信號(hào)處理器 |
| 文件頁數(shù)： | 114/154頁 |
| 文件大?。?/td> | 2365K |
| 代理商： | DSP1627 |
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Data Sheet
March 2000
DSP1627 Digital Signal Processor
114
Lucent Technologies Inc.
11 Timing Characteristics for 3.0 V Operation
(continued)
Figure 51. PHIF, PIBF, and POBE Reset Timing Diagram
POBE and PIBF can be programed to be active-high or active-low. They are shown active-high. The timing characteristic for active-low is the
same as for active-high.
Figure 52. PHIF, PIBF, and POBE Disable Timing Diagram
Table 134. PHIF Timing Characteristics for PHIF, PIBF, and POBE Reset
Abbreviated Reference
t57
t58
Parameter
Min
—
3
Max
25
25
Unit
ns
ns
RSTB Disable to POBE/PIBF
*
(high to valid)
RSTB Enable to POBE/PIBF* (low to invalid)
*
After reset, POBE and PIBF always go to the levels shown, indicating output buffer empty and input buffer empty. The DSP program, however,
may later invert the definition of the logic levels for POBE and PIBF. t57 and t58 continue to apply.
Table 135. PHIF Timing Characteristics for POBE and PIBF Disable
Abbreviated Reference
t59
Parameter
Min
—
Max
20
Unit
ns
CKO to POBE/PIBF
*
Disable (high/low to disable)
*
POBE and PIBF can be programmed to be active-high or active-low. They are shown active-high. The timing characteristic for active-low is
the same as for active-high.
RSTB
V
IH
–
V
IL
–
t58
t57
POBE
V
OH
–
V
OL
–
PIBF
V
OH
–
V
OL
–
5-4775 (F)
CKO
V
IH
–
V
IL
–
t59
t59
POBE
V
OH
–
V
OL
–
PIBF
V
OH
–
V
OL
–
5-4776 (F)
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PDF描述 |
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