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參數(shù)資料
| 型號(hào)： | DSP1627 |
| 英文描述： | TVS 400W 6.5V BIDIRECT SMA |
| 中文描述： | DSP1627數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 53/154頁(yè) |
| 文件大小： | 2365K |
| 代理商： | DSP1627 |
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Data Sheet
March 2000
DSP1627 Digital Signal Processor
Lucent Technologies Inc.
53
5 Software Architecture
(continued)
Table 38. ioc Register
*
*
The field definitions for the ioc register are different from the DSP1610.
Bit
Field
15
14
13
12
11
10
9
8—7
CKO[1:0]
6—4
RSVD
3—0
RSVD
EXTROM CKO2
EBIOH
WEROM
ESIO2
SIOLBC
DENB[3:0]
ioc Fields
ioc Field
EXTROM
CKO2
EBIOH
WEROM
ESIO2
SIOLBC
CKO[1:0]
DENB3
DENB2
DENB1
DENB0
Description
If 1, sets AB15 low during external memory accesses when WEROM = 1.
CKO configuration (see below).
If 1, enables high half of BIO, IOBIT[4:7], and disables VEC[3:0] from pins.
If 1, allows writing into external program (X) memory.
If 1, enables SIO2 and low half of BIO, and disables PHIF from pins.
If 1, DO1 and DO2 looped back to DI1 and DI2.
CKO configuration (see below).
If 1, delay EROM.
If 1, delay ERAMHI.
If 1, delay IO.
If 1, delay ERAMLO.
CKO2
CKO1
CKO0
CKO Output
Description
—
1X
CKI
PLL
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
CKI x M/(2N)
CKI x (M/(2N)) / [1 + W] Wait-stated clock.
*
,
1
0
CKI
CKI x (M/(2N)) / [1 + W] Sequenced, wait-stated clock.*,
,
,
§
Reserved
Reserved
Free-running clock.
CKI/(1 + W)
1
0
CKI
CKI/(1 + W)
*
When SLOWCKI is enabled in the powerc register, these options reflect the low-speed internal ring oscillator.
The wait-stated clock reflects the internal instruction cycle and may be stretched based on the mwait register setting (see Table 36). During
sequenced external memory accesses, it completes one cycle.
§ The sequenced wait-stated clock completes two cycles during a sequenced external memory access and may be stretched based on the
mwait register setting (see Table 36).
The phase of CKI is synchronized by the rising edge of RSTB.
Held high.*,
,
Held low.
Output of CKI buffer.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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