參數(shù)資料
型號： 23542A
英文描述： AMD-K6-IIIE+ Processor Data Sheet AMD-K6-2E+ Processor Data Sheet
中文描述： 的AMD - K6 - IIIE部處理器的數(shù)據(jù)資料的AMD - K6 - 2E處理器數(shù)據(jù)手冊
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Index
337
23542A/0—September 2000
AMD-K6-2E+ Embedded Processor Data Sheet
Preliminary Information
Capture-DR state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 262
Capture-IR state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 262
Case Temperature. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 317
extended . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 313
measuring . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 317
Centralized Scheduler . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
CLK
switching characteristics
100-MHz bus operation . . . . . . . . . . . . . . . . . . . . . . . . 296
60-MHz bus operation . . . . . . . . . . . . . . . . . . . . . . . . . 297
CLK Signal. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
capacitance . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 288
Clock Control. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .105
,
275
states . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 275
enhanced power management stop grant . . . . . . . . . 275
halt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 278
normal . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 275
state transitions (figure) . . . . . . . . . . . . . . . . . . . 276
–
277
stop clock. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .193
,
283
stop grant. . . . . . . . . . . . . . . . . . . . . . . . . . . 193
,
278
,
281
stop grant inquire. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 280
switching characteristics
100-MHz bus operation . . . . . . . . . . . . . . . . . . . . . . . . 296
66-MHz bus operation . . . . . . . . . . . . . . . . . . . . . . . . . 297
Coherency
cache . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 222
writeback. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 227
writethrough . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 227
Compatibility, Floating-Point, MMX, and 3DNow!
Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 240
Component Placement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 292
Configuration
power-on initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . 199
signal timing (figure) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 311
signal timing for 100-MHz bus operation (table). . . . . . 306
signal timing for 66-MHz bus operation . . . . . . . . . . . . . 307
VCC pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 200
Connections
pin requirements. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 293
power requirements . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 291
Control Register 0 (CR0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
Control Register 1 (CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
Control Register 2 (CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Control Register 3 (CR3) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Control Register 4 (CR4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Counter, Time Stamp . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
CPGA Package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2
–
3
pin designations (figure) . . . . . . . . . . . . . . . . . . . . . . . . . 322
pin designations by function (table). . . . . . . . . . . . . . . . 324
pin differences (table. . . . . . . . . . . . . . . . . . . . . . . . . . . . 321
specification . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 331
CR4 Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46
Customer Service . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . iii
Cycles
bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153
hold and hold acknowledge . . . . . . . . . . . . . . . . . . . . . . . 168
inquire . . . 94
–
99
,
109
,
113
–
114
,
131
,
139
,
164
,
168
,
170
,
. . . .172
,
174
,
176
–
178
,
182
,
186
,
222
,
263
,
275
,
278
–
280
inquire and bus arbitration . . . . . . . . . . . . . . . . . . . . . . . 168
interrupt acknowledge. . . . . . . .95
,
98
,
100
,
106
,
123
,
138
locked. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 184
pipelined . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .17
,
96
pipelined write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107
shutdown . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192
special bus. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 190
writeback . . . . . . 94
,
96
–
97
,
110
,
113
,
139
,
164
,
172
,
176
,
. . . . . . . . . . . . . . . . . . . . . 178
,
180
,
186
,
210
,
264
,
277
,
280
D
D/C# Signal. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .106
D[63:0] Signals. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .107
Data
bus
AHOLD restriction . . . . . . . . . . . . . . . . . . . . . . . . 97
,
180
AHOLD timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .174
aligned transfers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .129
BRDY# timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .103
byte enable signals . . . . . . . . . . . . . . . . . . . . . . . . . . . .100
D[63:0] signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .107
data state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .156
memory reads and writes . . . . . . . . . . . . . . . . . . . . . . .158
misaligned transfers . . . . . . . . . . . . . . . . . . . . . . 129
,
184
parity . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108
,
125
split cycles . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .129
transition . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .157
cache. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .16
MESI states . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .207
parity . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .108
types
3DNow! Technology. . . . . . . . . . . . . . . . . . . . . . . . . . .37
floating-point register. . . . . . . . . . . . . . . . . . . . . . . . . . .34
integer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
MMX technology . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .36
Data/Code Signal. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .106
Data-NA# Requested State. . . . . . . . . . . . . . . . . . . . . . . . . .156
DC Characteristics. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .287
Debug . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .268
exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .273
registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
,
269
DR3–DR0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .271
DR5–DR4 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .271
DR6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .272
DR7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .272
System Management Mode (SMM) . . . . . . . . . . . . .249
–
250
Decoders. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .13
Decoupling Recommendations . . . . . . . . . . . . . . . . . . . . . .292
Descriptors and Gates. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .59
Device Identification Register (DIR) . . . . . . . . . . . . . . . . .258
Diagrams
key. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .309
timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153
,
309
–
312
waveform definitions. . . . . . . . . . . . . . . . . . . . . . . . . . . . .153
Digital Signal Processing Instructions . . . . . . . . . . . . . . . . .90
DIR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .258
Dissipation, Power. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .289
Documentation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . iii
DP[7:0] Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .108
DR3–DR0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .271
DR5–DR4 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .271
DR6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .272
DR7. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .272
Driven signal . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .93
DSP Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90
,
239
Dual Voltage. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .291
相關(guān)PDF資料
PDF描述
2355 PAINT ARSL FLAT BLCK 400ML
2358026 ADHESIVE BLACK 453G TUB
236-332 5V EconoReset with Active High Push-Pull Output
236-402 5V EconoReset with Active High Push-Pull Output
236-403 KLEMMLEISTE 3POL 16A LICHTGRAU
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
23542-R 制造商:Thomas & Betts 功能描述:HEAT SHRINK
23543 制造商:Thomas & Betts 功能描述:HEAT SHRINK
23544 制造商:Thomas & Betts 功能描述:HEAT SHRINK
235440 制造商:RCA 功能描述:
23-544-3 制造商:Johnson Components 功能描述:old inventory
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