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參數(shù)資料
| 型號： | 23542A |
| 英文描述： | AMD-K6-IIIE+ Processor Data Sheet AMD-K6-2E+ Processor Data Sheet |
| 中文描述： | 的AMD - K6 - IIIE部處理器的數(shù)據(jù)資料的AMD - K6 - 2E處理器數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 212/368頁 |
| 文件大?。?/td> | 5669K |
| 代理商： | 23542A |
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190
Bus Cycles
Chapter 7
AMD-K6-2E+ Embedded Processor Data Sheet
23542A/0—September 2000
Preliminary Information
7.6
Special Bus Cycles
The AMD-K6-2E+ processor drives special bus cycles that
include the following:
I
Stop grant
Enhanced power management
Flush acknowledge
Cache writeback invalidation
Halt
Cache invalidation
Shutdown
I
I
I
I
I
I
During all special cycles, D/C# = 0, M/IO# = 0, and W/R# = 1.
BE[7:0]# and A[31:3] are driven to differentiate among the
special cycles, as shown in Table 33.
Note that the system logic must return BRDY# in response to all
processor special cycles.
Basic Special Bus
Cycle
Figure 77 on page 191 shows a basic special bus cycle.
The processor drives D/C# = 0, M/IO# = 0, and W/R# = 1 off the
same clock edge that it asserts ADS#.
In this example, BE[7:0]# = FBh and A[31:3] = 0000_0000h,
which indicates that the special cycle is a halt special cycle (See
Table 33. Encodings for Special Bus Cycles
BE[7:0]#
A[4:3]
1
10b
Notes:
1.
2. Supported on the low-power versions only.
A[31:5] = 0
Special Bus Cycle
Cause
FBh
Stop Grant
STPCLK# sampled asserted
A dword access is made to the EPM 16-byte I/O block and the GSBC bit of the
EPMR register is set to 1
FLUSH# sampled asserted
WBINVD instruction
HLT instruction
INVD,WBINVD instruction
Triple fault
BFh
00b
EPM Stop Grant
2
EFh
F7h
FBh
FDh
FEh
00b
00b
00b
00b
00b
Flush Acknowledge
Writeback
Halt
Flush
Shutdown
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