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參數(shù)資料
| 型號(hào)： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 594/609頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標(biāo)準(zhǔn)包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應(yīng)商設(shè)備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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PRELIMINARY
XRT79L71
70
REV. P2.0.0
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
TABLE 13: LIST AND DESCRIPTION OF THE PINS ASSOCIATED WITH THE TRANSMIT PAYLOAD DATA INPUT INTERFACE
BLOCK
SIGNAL NAME
PIN/BALL #
TYPE
DESCRIPTION
TxSer
C9
I
Transmit Serial Payload Data Input Pin:
If the Transmit Payload Data Input Interface block is operated in the Serial Mode,
then the System-Side equipment is expected to apply the payload data that is to
be transported via the outbound DS3 data-stream to this input pin, in a serial
manner. The XRT79L71 samples the data that is on this input pin upon the rising
edge of either the RxOutClk for loop-timing applications or the TxInClk signal or
local-timing applications.
NOTE: This signal is only active if the NibIntf input pin is pulled "Low".
TxNib[3:0]
B8
C8
D8
A9
I
Transmit Nibble-Parallel Payload Data Input pins:
If the Transmit Payload Data Input Interface block is operated in the Nibble-Par-
allel Mode, then the System-Side equipment is expected to apply the payload
data that is to be transported via the outbound DS3 data-stream to these input
pins, in a nibble-parallel manner. The XRT79L71 samples the data that is placed
on these input pins upon the third rising edge of TxInClk, following a given rising
edge of the TxNibClk output pin.
NOTE: These signals are only active if the NibIntf input pin is pulled "High".
TxNibFrame
A10
O
Transmit End of Frame Output Indicator - Nibble Mode:
The Transmit Section of the XRT79L71 pulses this output pin "High" for one nib-
ble period whenever the Transmit Payload Data Input Interface block is process-
ing the very last nibble within a given DS3 frame. The purpose of this output pin
is to alert the System-Side Terminal Equipment that it needs to begin transmis-
sion of a new DS3 frame to the Transmit Payload Data Input Interface of the
XRT79L71.
NOTE: This output pin is only active if the XRT79L71 has been configured to
operate in the Nibble-Parallel Mode
TxInClk
C10
I
Transmit Section - Timing Reference Clock Input pin:
If the XRT79L71 has been configured to operate in the Local-Timing Mode, then
this input pin will function as the timing source for the Transmit Circuitry within the
XRT79L71.
Additionally, if the XRT79L71 has been configured to operate in both the Serial
and Local-Timing Mode, then the XRT79L71 will sample the data, residing on the
TxSer input pin, upon the rising edge of this input clock signal.
TxNibClk
D9
O
Transmit Nibble-Mode Clock Output SignalIf the XRT79L71 has been configured
to operate in the Nibble-Parallel Mode, then the XRT79L71 will derive this output
clock signal from either the TxInClk or the LIU Recovered Clock signal.
NOTE: The frequency of this clock output signal is approximately one-fourth of
the TxInClk or the RxOutClk signals.
The user is advised to update the Nibble-Parallel data via the TxNib[3:0] output
pins, upon the rising edge of this clock output signal. The XRT79L71 will sample
the TxNib[3:0] input pins upon the third rising edge of the TxInClk clock input sig-
nal following a rising edge in this particular signal.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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