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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 133/609頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標準包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應商設備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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XRT79L71
PRELIMINARY
203
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
Conversely, setting Bit 1 (F-Algorithm) within the Receive DS3 Sync Detect Register to "0" configures the
Receive DS3 Framer block to declare F-bit Sync after the successful detection of 10 consecutive F-bits.
Handling of Mimicking F-bits
It was mentioned earlier that the Receiver DS3 Framer block, when operating in the Frame Acquisition Mode,
will use five (5) Framing Bit Searching circuits in parallel. As each of these Framing Bit Searching circuits
parses through the incoming DS3 data-stream, they are each searching for a sequence of bits that exhibit a
certain pattern and spacing from each other. At any given time, it may be possible that more than one Framing
Bit Searching circuit has honed in on more than one viable F-bit candidate. Whenever this occurs, it may be
possible for the Receive DS3 Framer block to become fooled by data bits mimicking the F-bits.
This
phenomenon can result in the Receive DS3 Framer block proceeding along the DS3 Frame Acquisition/
Maintenance State Machine, while being locked onto to mimicking data, and not to the actual F-bits. At some
point, the Receive DS3 Framer block will recognize that it is not locked onto the actual F-bits and that it will
have to return to the F-Bit Search state. However, all of the time that the Receive DS3 Framer block spent,
proceeding along with the M-Bit Search state will have been wasted and will increase the overall Frame
Acquisition time.
The Command Register set, within the XRT79L71, permits the user to minimize the potential of the Framing Bit
Searching circuitry being fooled by mimicking data, by setting Bit 0 (One and Only), within the Receive DS3
Sync Detect Register to "1", as illustrated below.
If this configuration option is implemented, then the Receive DS3 Framer block will only declare F-Bit Sync
when all of the following criteria are met.
A given Framing Bit Searching circuit has successfully located 10 or 16 consecutive, correct F-bits.
None of the remaining four (4) Framing Bit Searching circuits have any viable candidates for F-bits. One and
Only one viable candidate exists for all of the five Framing Bit Searching circuits.
The M-bit Search State
When the Receive DS3 Framer block reaches the M-Bit Search state, it will begin searching for valid M-bits
within the incoming DS3 data-stream. In order to clearly convey the mode that the Receive DS3 Framer block
is currently operating in, Figure 91 has been repeated below, with the M-Bit Search state shaded.
Receive DS3 Sync Detect Register (Address = 0x1114)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
F Algorithm
One and
Only
R/O
R/W
0
1
0
Receive DS3 Sync Detect Register (Address = 0x1114)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
F Algorithm
One and
Only
R/O
R/W
0
X
01
相關PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
| XRT83L30IV-F | IC LIU LH/SH T1/E1 SGL 64TQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT79L72 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L72IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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