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參數(shù)資料
| 型號： | uPSD3233 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash Programmable System Device with 8032 Microcontroller Core(嵌入高速“8032微控制器核”的Flash型可編程系統(tǒng)器) |
| 中文描述： | 閃存可編程系統(tǒng)器件與8032微控制器內(nèi)核（嵌入高速“8032微控制器核”的閃存型可編程系統(tǒng)器） |
| 文件頁數(shù)： | 33/164頁 |
| 文件大?。?/td> | 1133K |
| 代理商： | UPSD3233 |
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33/164
μ
PSD3200 FAMILY
DRAFT(Thursday 20 June 2002, 13:15).
Note: (Register address = csiop address + address offset; where csiop address is defined by user in PSDsoft))
* indicates bit isnot used and need to set to 0
1B
Enable Out(Port
D)
*
*
*
*
*
*
Only Bit 1and
2 are used
20
Output
Macrocells AB
21
Output
Macrocells BC
22
Mask
Macrocells AB
23
Mask
Macrocells BC
C0
Primary Flash
Protection
Sec7_
Prot
Sec6
_Prot
Sec5_
Prot
Sec4
_Prot
Sec3
_Prot
Sec2
_Prot
Sec1_
Prot
Sec0_
Prot
Bit = 1 sector
is protected
C2
Secondary
Flash Protection
Securi
ty_Bit
*
*
*
Sec3
_Prot
Sec2
_Prot
Sec1_
Prot
Sec0_
Prot
Security Bit =
1 device is
secured
C7
JTAG Enable
*
*
*
*
*
*
*
JTAG
SWEN
00
JTAG_SWEN
=1 JTAGis
enabled
B0
PMMR0
*
*
PLD
Mcells
clk
PLD
array-
clk
PLD
Turbo
*
APD
enable
*
00
Control PLD
power
consumption
B4
PMMR2
*
PLD
array
WRh
PLD
arrayA
le
PLD
array
Cntl2
PLD
array
Cntl1
PLD
array
Cntl0
*
*
00
Blocking
inputs to PLD
array
E0
Page
00
Page Register
E2
VM
Periph
-mode
*
*
FL_d
ata
Boot
_data
FL_c
ode
Boot_c
ode
SR_co
de
Configure
8032 Program
and Data
Space
CSIO
PAddr
Offset
Register Name
Bit Register Name
Reset
Value
Comments
7
6
5
4
3
2
1
0
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PDF描述 |
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參數(shù)描述 |
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| UPSD3233A-24T1T | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Flash Programmable System Devices with 8032 Microcontroller Core |
| UPSD3233A-24T6 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Flash Programmable System Device with 8032 Microcontroller Core |
| UPSD3233A-24T6T | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Flash Programmable System Devices with 8032 Microcontroller Core |
| UPSD3233A-24U1 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Flash Programmable System Device with 8032 Microcontroller Core |
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