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參數(shù)資料
| 型號： | uPSD3233 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash Programmable System Device with 8032 Microcontroller Core(嵌入高速“8032微控制器核”的Flash型可編程系統(tǒng)器) |
| 中文描述： | 閃存可編程系統(tǒng)器件與8032微控制器內(nèi)核（嵌入高速“8032微控制器核”的閃存型可編程系統(tǒng)器） |
| 文件頁數(shù)： | 116/164頁 |
| 文件大?。?/td> | 1133K |
| 代理商： | UPSD3233 |
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μ
PSD3200 FAMILY
116/164
DRAFT(Thursday 20 June 2002, 13:15).
Table 90. Port Operating Modes
Note: 1. Can be multiplexed withother I/O functions
2. Port A is not available in the 52-pin package
Table 91. Port Operating Mode Settings
Note: 1. N/A = Not Applicable
2. The direction of the Port A,B,C, and D pins are controlled by the Direction Register ORed with the individual output enable product
term (.oe) from the CPLD AND Array.
3. Any of these three methods enables the JTAG pins on Port C.
Port Mode
Port A
2
Port B
Port C
Port D
MCU I/O
Yes
Yes
Yes
Yes
PLD I/O
McellAB Outputs
McellBC Outputs
Additional Ext. CS Outputs
PLD Inputs
Yes
No
No
Yes
Yes
Yes
No
Yes
No
Yes
No
Yes
No
No
Yes
Yes
Address Out
Yes (A7 – 0)
Yes (A7 – 0)
No
No
Peripheral I/O
Yes
No
No
No
JTAG ISP
No
No
Yes
1
No
Mode
Defined in PSDsoft
Control
Register Setting
Direction
Register Setting
VM Register
Setting
JTAG Enable
MCU I/O
Declare pins only
0
1 = output,
0 = input (Note
2
)
N/A
N/A
PLD I/O
Logic equations
N/A
(Note
2
)
N/A
N/A
Address Out
(Port A,B)
Declare pins only
1
1 (Note
2
)
N/A
N/A
Peripheral I/O
(Port A)
Logic equations
(PSEL0 & 1)
N/A
N/A
PIO bit = 1
N/A
JTAG ISP (Note
3
)
JTAGSEL
N/A
N/A
N/A
JTAG_Enable
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