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參數(shù)資料
| 型號： | PM5372-BI |
| 英文描述： | Telecommunication IC |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 82/169頁 |
| 文件大?。?/td> | 989K |
| 代理商： | PM5372-BI |
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TSE Transmission Switch Element Datasheet
Released
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-1991258, Issue 7
82
Register 0021H, 00025H, 0029H, 002DH: CSTR #1 – #4 Interrupt Enable and CSU Lock
Status
Bit
Type
Function
Default
Bit 15
Unused
X
Bit 14
Unused
X
Bit 13
Unused
X
Bit 12
Unused
X
Bit 11
Unused
X
Bit 10
Unused
X
Bit 9
Unused
X
Bit 8
Unused
X
Bit 7
Unused
X
Bit 6
Unused
X
Bit 5
Unused
X
Bit 4
Unused
X
Bit 3
Unused
X
Bit 2
Unused
X
Bit 1
R
LOCKV
X
Bit 0
R/W
LOCKE
0
This register configures the operation of CSTR blocks #1 through #4.
LOCKE
The CSU lock interrupt enable bit (LOCKE) controls the contribution of CSU lock state
interrupts by the CSTR to the device interrupt INTB. When LOCKE is high, INTB is asserted
low when the CSU lock state changes. Interrupts due to CSU lock state are masked when
LOCKE is set low.
LOCKV
The CSU lock status bit (LOCKV) indicates whether the clock synthesis unit has successfully
locked with the system clock. LOCKV is set low when the CSU has not successfully locked
with the reference clock. LOCKV is set high if when the CSU has locked with the reference
clock.
相關(guān)PDF資料 |
PDF描述 |
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| PM555 | 1 to 10 watt encapsulated power modules |
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| PM560 | Precision Quad Supply Monitor in 6-Lead SOT-23; Package: SOT; No of Pins: 6; Temperature Range: 0°C to +70°C |
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參數(shù)描述 |
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