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參數(shù)資料
| 型號： | pentium II xeon processor |
| 廠商： | Intel Corp. |
| 英文描述： | pentium II xeon processor at 400 and 450 MHZ(工作頻率400和450兆赫茲奔II處理器) |
| 中文描述： | 奔騰II至強處理器400和450兆赫（工作頻率400和450兆赫茲奔二處理器） |
| 文件頁數(shù)： | 34/97頁 |
| 文件大?。?/td> | 978K |
| 代理商： | PENTIUM II XEON PROCESSOR |
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PENTIUM II XEON PROCESSOR AT 400 AND 450 MHZ
E
34
12/15/98 5:14 PM 24377002.doc
3.1.
System Bus Clock Signal
Quality Specifications
Table 18 describes the signal quality specifications at
the processor core pad for the Pentium II Xeon
processor system bus clock (BCLK) signal.
Figure 13 shows the signal quality waveform for the
system bus clock at the processor core pads. Please
see Table 11 for the definition of T numbers and
Table 18 for the definition of V numbers.
Table 18. BCLK Signal Quality Specifications for Simulation at the Processor Core
1
V#
Parameter
Min
Nom
Max
Unit
Figure
Notes
V1:
BCLK V
IL
BCLK V
IH
V
IN
Absolute Voltage Range
Rising Edge Ringback
0.7
V
13
V2:
1.7
V
13
V3:
–0.7
3.3
V
13
V4:
1.7
V
13
2
V5:
Falling Edge Ringback
0.7
V
13
2
NOTES:
1.
Unless otherwise noted, all specifications in this table apply to all Pentium
II Xeon processor frequencies and cache
sizes.
The rising and falling edge ringback voltage specified is the minimum (rising) or maximum (falling) absolute voltage the
BCLK signal can dip back to after passing the V
IH
(rising) or V
IL
(falling) voltage limits. This specification is an absolute
value.
2.
V2
V1
V3
V3
T3
V5
V4
T6
T4
T5
3770-13
Figure 13. BCLK, TCK, PICCLK Generic Clock Waveform at the Processor Core Pins
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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