參數(shù)資料
型號(hào)： NS32490D
廠商： National Semiconductor Corporation
英文描述： NIC Network Interface Controller(NIC網(wǎng)絡(luò)接口控制器)
中文描述： NIC網(wǎng)絡(luò)接口控制器（NIC網(wǎng)絡(luò)接口控制器）
文件頁(yè)數(shù)： 43/56頁(yè)
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代理商： NS32490D
15.0 Switching Characteristics
(Continued)
DMA Control, Bus Arbitration
TL/F/8582–80
Symbol
Parameter
Min
Max
Units
brqhl
Bus Clock to Bus Request High for Local DMA
43
ns
brqhr
Bus Clock to Bus Request High for Remote DMA
38
ns
brql
Bus Request Low from Bus Clock
55
ns
backs
Acknowledge Setup to Bus Clock
(Note 1)
2
ns
bccte
Bus Clock to Control Enable
60
ns
bcctr
Bus Clock to Control Release
(Notes 2, 3)
70
ns
Note 1:
BACK must be setup before T1 after BREQ is asserted. Missed setup will slip the beginning of the DMA by four bus clocks. The Bus Latency will influence
the allowable FIFO threshold and transfer mode (empty/fill vs exact burst transfer).
Note 2:
During remote DMA transfers only, a single bus transfer is performed. During local DMA operations burst mode transfers are performed.
Note 3:
These limits include the RC delay inherent in our test method. These signals typically turn off within 15 ns enabling other devices to drive these lines with
no contention.
43
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