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參數(shù)資料
| 型號： | MC92604ZT |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 83/122頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC TXRX ETH DUAL GIG 196-MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 630 |
| 類型： | 收發(fā)器 |
| 驅(qū)動器/接收器數(shù)： | 2/2 |
| 規(guī)程： | 千兆位以太網(wǎng) |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 196-LBGA |
| 供應(yīng)商設(shè)備封裝： | 196-MAPBGA（15x15） |
| 包裝： | 托盤 |
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Management Interface (MDIO)
MC92604 Dual Gigabit Ethernet Transceiver Reference Manual, Rev. 1
Freescale Semiconductor
4-7
4.2.5
MDIO RA 5—Auto-Negotiation Link Partner Ability Register
Figure 4-5 shows the format for the auto-negotiation (AN) link partner register, MDIO RA 5, in the
MC92604. Register 5 is a read-only register and contains the advertised ability of the link partner.
Table 4-5 lists the corresponding field descriptions for the AN link partner ability register.
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
R
Next
Page
Acknowledge
Remote
Fault 2
Remote
Fault 1
Reserved
Pause 2 Pause 1
Half-
Duplex
Full-
Duplex
Reserved
W
Reset
0
0 0 0 0 0
Figure 4-5. AN Link Partner Ability Register (MDIO RA 5)
Table 4-5. AN Link Partner Ability Register Field Descriptions
Bits
Name
Description1
1 R = read-only.
15
Next Page
The MC92604 does not support multiple pages of configuration registers and ignores this
bit. (R)
14
Acknowledge
Ack is set when the link partner acknowledges receipt of the advertised transmitted
capabilities. (R)
13
Remote fault 2
Bits 13 and 12 are the remote status of the link partner. (R)
RF1
RF2
Interpretation
0
Link OK
12
Remote fault 1
0
1
Offline
1
0
Link_Failure
1
Auto-Negotiation_Error
11–9
Reserved
This bit is ignored
. (R)
8
Pause 1
PS1 and PS2 are pause control bits that reflect the values of bits 12 and 13 in MDIO RA 4
of the link partner. (R)
7
Pause 0
6
Half-duplex
Forced to zero. The MC92604 does not support half-duplex mode. (R)
5
Full-duplex
Forced to one. The MC92604 always runs in full-duplex mode. (R)
4–0
Reserved
This bit is ignored
. (R)
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PDF描述 |
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