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參數(shù)資料
| 型號(hào)： | MC92604ZT |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 119/122頁 |
| 文件大小： | 0K |
| 描述： | IC TXRX ETH DUAL GIG 196-MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 630 |
| 類型： | 收發(fā)器 |
| 驅(qū)動(dòng)器/接收器數(shù)： | 2/2 |
| 規(guī)程： | 千兆位以太網(wǎng) |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 196-LBGA |
| 供應(yīng)商設(shè)備封裝： | 196-MAPBGA（15x15） |
| 包裝： | 托盤 |
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Electrical Specifications and Characteristics
MC92604 Dual Gigabit Ethernet Transceiver Reference Manual, Rev. 1
7-14
Freescale Semiconductor
7.3.6
JTAG Test Port Timing
This section describes the AC electrical specifications for the IEEE Std. 1149.1 (JTAG) interface of the
MC92604. Figure 7-11 provides the JTAG I/O Timing Diagram.
Figure 7-11. JTAG I/O Timing Diagram
Table 7-15 provides the JTAG I/O timing specifications.
Table 7-15. JTAG I/O Timing Specifications
Symbol
Characteristic
Min
Max
Unit
T1
Output propagation time after falling edge of TCK1
1 10 pF output load
1.0
8.0
ns
T2
Setup time to rising edge of TCK
1.0
—
ns
T3
Hold time to rising edge of TCK
0.5
—
ns
fTCK
TCK frequency
—
20
MHz
TD
TCK duty cycle
35
65
%
tr, tf
TCK input rise/fall time
—
2
ns
T4
TRST assert pulse width
25
—
ns
TCK
TDO
TDI
TMS
T2
T3
T1
1/fTCK
TRST
T4
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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