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參數(shù)資料
| 型號： | ARM610 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | General Purpose 32-Bit Microprocessor with 4kByte Cache,Write Buffer and Memory Management Unit(通用32位微處理器（帶4K字節(jié)緩存，寫緩沖器和存儲器管理單元）) |
| 中文描述： | 通用32位微處理器4KB的高速緩存，寫緩沖器和存儲器管理單元（通用32位微處理器（帶4K的字節(jié)緩存，寫緩沖器和存儲器管理單元）） |
| 文件頁數(shù)： | 52/174頁 |
| 文件大?。?/td> | 694K |
| 代理商： | ARM610 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁當(dāng)前第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁
Instruction Set - LDR, STR
ARM610 Data Sheet
4-24
O
4.7
Single Data Transfer (LDR, STR)
The instruction is only executed if the condition is true. The various conditions are
defined in
·
Table 4-2: Condition code summaryon page 4-6. The instruction encoding
is shown in
·
Figure 4-12: Single data transfer instructionson page 4-24.
The single data transfer instructions are used to load or store single bytes or words of
data. The memory address used in the transfer is calculated by adding an offset to or
subtracting an offset from a base register.
The result of this calculation may be written back into the base register if auto-indexing
is required.
Figure 4-12: Single data transfer instructions
26
25
24
23
22
21
0
01
I
P
U
B
W
L
Rn
Rd
11
0
IImmediate offset
11 = Offset is a register
Shift
Rm
11
4
3
0
SShift
Rm
Rm
sshift applied to Rm
Condition field
31
288 27
26
25
24
23
22
21
220 19
116 15
112 11
0
Cond
01
I
P
U
B
W
L
Rn
Rd
Offset
Source/Destination register
Base register
Load/Store bit
00 = Store to memory
11 = Load from memory
Write-back bit
00 = No write-back
11 = Write address into space
Byte/Word bit
00 = Transfer word quantity
11 = Transfer byte quantity
Up/Down bit
00 = Down; subtract offset from base
11 = Up; add offset from base
Pre/Post indexing bit
00 = Post; add offset after transfer
11 = Pre; add offset before transfer
IImmediate offset
00 = Offset is an immediate value
11
0
Unsigned 12-bit immediate offset
11
4
3
0
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