參數(shù)資料
型號： 84220
廠商： LSI Corporation
英文描述： Quad 100BaseTX/100BaseFX/10BaseT Physical Layer Device （Highly Integrated Ethernet Transceiver For Twisted Pair And Fiber Ethernet Applications）(四通道100BaseTX/100BaseFX/10BaseT 物理層處理器（高度集成的以太網(wǎng)雙絞線和光纖數(shù)據(jù)收發(fā)器）)
中文描述： 四100BaseTX/100BaseFX/10BaseT物理層裝置（高度集成的以太網(wǎng)收發(fā)器，雙絞線和光纖以太網(wǎng)的應用）（四通道100BaseTX/100BaseFX/10BaseT物理層處理器（高度集成的以太網(wǎng)雙絞線和光纖數(shù)據(jù)收發(fā)器） ）
文件頁數(shù)： 19/92頁
文件大小： 1401K
代理商： 84220
MD400177/B
84220
19
Table 2. TP Transmit Level Adjust
Bits TLVL[3:0]
Gain
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1011
1100
1101
1110
1111
1.16
1.14
1.12
1.10
1.08
1.06
1.04
1.02
1.00
0.98
0.96
0.94
0.92
0.90
0.88
0.86
2.8.4 Transmit Rise and Fall Time Adjust
The transmit output rise and fall time can be adjusted with
the two transmit rise/fall time adjust bits in the MI serial
port Channel Configuration register as shown in Table 3.
The adjustment range is -0.25 ns to +0.50 nS in 0.25 ns
steps.
Rise and Fall time Adjustment is only available in 100
Mbps operating mode.
Table 3. Transmit Rise and Fall Time Adjust
Bits TRF[1:0]
Adjustment
11
10
01
00
-0.25 ns
0.00 ns
+0.25 ns
+0.5 ns
a. Short Bit
b. Long Bit
3.1 V
Slope 0.5 V/ns
585 mV
PW
0
3.1 V
Slope 0.5 V/ns
585 mV
PW/4
0
3PW/4
PW
585 mV sin ( *
585 mV sin ( *
585 mV sin [2 (t - PW2)/PW]
Figure 5. TP Input Voltage Template - 10 Mbps
相關(guān)PDF資料
PDF描述
84221 84221 Quad 10/100 Mbps TX/FX/10BT (PHY) manual 1/99
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84301 84301 4-Port Fast Ethernet Controller manual 3/98
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84717000 MINIATURNAEHERUNGSSCHALTER 4MM GLATT PNP
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8422002AGI-01 制造商:Integrated Device Technology Inc 功能描述:8422002AGI-01 - Rail/Tube
8422002AGI-01LF 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:FEMTOCLOCKS⑩ CRYSTAL-TOLVHSTL FREQUENCY SYNTHESIZER
8422002AGI-01LFT 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:FEMTOCLOCKS⑩ CRYSTAL-TOLVHSTL FREQUENCY SYNTHESIZER
8422002AGI-01T 制造商:Integrated Device Technology Inc 功能描述:8422002AGI-01T - Tape and Reel
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