參數(shù)資料
型號: S82451KX
廠商: INTEL CORP
元件分類: 微控制器/微處理器
英文描述: SPECIALTY MICROPROCESSOR CIRCUIT, PQFP144
封裝: QFP-144
文件頁數(shù): 9/180頁
文件大?。?/td> 1094K
代理商: S82451KX
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98
PRELIMINARY
82453KX/GX, 82452KX/GX, 82451KX/GX (MC)
A
1.3
MIC Signals
.
Table 13. Control Interface Signals (MIC)
Signal
Type
Description
MICCMD[6:0]#
I
CMOS
MIC COMMAND. These signals send read/write/configuration commands to
the MIC.
MICMWC#
I
CMOS
MIC MEMORY WRITE COMMAND. This signal instructs the MIC to drive
write data held in its internal buffers on the memory data bus.
Table 14. Data Path Interface Signals (MIC)
Signal
Type
Description
MDE[17:0]
I/O
CMOS
MEMORY DATA AND ECC. MDE[17:0] is one fourth of a Qword and is
connected to one of the word portions of the DP memory data bus. ECC is
computed over 64-bit data words. MDE[17:0] is one fourth of a Qword.
MDRDY#
I
CMOS
MEMORY DATA READY. The DP asserts this signal to the MIC when data on
the MDE bus is valid.
Table 15. Memory Interface Signals (MIC)
Signal
Type
Description
I0D[17:0]
I/O
CMOS
MEMORY DATA. I0D[17:0] is one fourth of a QWord that is connected to
interleave zero of the memory.
I1D[17:0]
I/O
CMOS
MEMORY DATA. I1D[17:0] is one fourth of a QWord that is connected to
interleave one of the memory.
I2D[17:0]
I/O
CMOS
MEMORY DATA. I2D[17:0] is one fourth of a QWord that is connected to
interleave two of the memory.
I3D[17:0]
I/O
CMOS
MEMORY DATA. I3D[17:0] is one fourth of a QWord that is connected to
interleave three of the memory.
Table 16. Clock and Reset Signals (MIC)
Signal
Type
Description
BCLK
I
CMOS
BUS CLOCK. This is the clock input to the device.
MIRST#
I
CMOS
MEMORY INTERFACE RESET. This signal is connected to the MIRST# signal on
the DC.
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