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參數(shù)資料
| 型號(hào)： | S82451KX |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PQFP144 |
| 封裝： | QFP-144 |
| 文件頁(yè)數(shù)： | 154/180頁(yè) |
| 文件大?。?/td> | 1094K |
| 代理商： | S82451KX |
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PRELIMINARY
67
A
82454KX/GX (PB)
Figure 8. BPRI# Arbitration Overlapped with Bridge Transfer
Dual PB Configuration (82454GX only)
Figure 9. IOGNT# & IOREQ# Pull-Ups/Pull-Downs (Dual Bridge System)
12
345678
9
10
IOREQ#
IOGNT#
BPRI#
ADS#
BCLK
compatibility bridge
asserts BPRI#
other bridge sees
BPRI# released
other bridge
asserts BPRI#
compatibility bridge
asserts ADS#
other bridge
asserts ADS#
other bridge
asserts IOREQ#
compatibility bridge
asserts IOREQ# indicate grant to other bridge
IOREQ# and IOGNT# refer to the bridge making a request to the Compatibility PB’s arbiter.
Bridge-to-Bridge Communication
PB-to-PB communication is supported by the PB, but is not recommended for optimal performance.
PB-to-PB transactions involving a standard bus bridge (SIO, PCEB/ESC) require special precautions to avoid
deadlock and latency problems. The PB does NOT support PB-to-PB transactions from agents that cannot be
backed off such as those originating on an ISA or EISA bus and targeting a device on a different PB’s PCI bus.
Any device that asserts FLSHBUF# must be targeting a device on the local PCI bus or the host bus.
During a power-on reset (PWRGD asserted), IOREQ# and IOGNT# provide a unique identification number for
each PB (PBID). The PBID is part of the PB’s PCI Bridge Device Number and is available to programmers via
the BDNUM Register (offset 49h). The Dual PB system must have a pull-up and a pull-down as shown in
Figure 9. The encoding for these signals is shown in Table 10
IOREQ#
IOGNT#
IOREQ#
IOGNT#
Vcc
Auxiliary
Compatibility
Bridge
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PDF描述 |
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