參數(shù)資料
型號: S5935
廠商: Applied Micro Circuits Corp.
英文描述: PCI 5V Bus Master/Target Device 32-bit
中文描述: 5V的的PCI總線主/目標設(shè)備的32位
文件頁數(shù): 72/190頁
文件大小: 748K
代理商: S5935
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5-64
ADD-ON BUS OPERATION REGISTERS
S5935
ADD-ON PASS-THRU ADDRESS
REGISTER (APTA)
Register Name:
Add-On Pass-Thru Address
Add-On Address Offset:28h
Power-up value:
XXXXXXXXh
Attribute:
Read Only
Size:
32 bits
This register is employed when a response is desired
when one of the Base address decode regions is
selected during an active PCI bus cycle. When one of
the base address decode registers 1-4 encounters a
PCI bus cycle which selects the region defined by it,
this device latches that current cycle’s active address
and asserts the signal PTATN# (Pass-Thru Atten-
tion). Wait states are generated on the PCI bus until
either data is transferred or the PCI bus cycle is
aborted by the initiator.
This register provides a method for “l(fā)ive” data (regis-
tered) transfers. Intended uses include the emulating
of other hardware as well as enabling the connection
of existing external hardware to interface to the PCI
bus through the S5935.
ADD-ON PASS-THRU DATA
REGISTER (APTD)
Register Name:
Add-On Pass-Thru Data
Add-On Address Offset:2Ch
Power-up value:
XXXXXXXXh
Attribute:
Read/Write
Size:
32 bits
This register, along with APTA described above, is
employed when a response is desired should one of
the Base address decode regions become selected
during an active PCI bus cycle. When one of the
base address decode registers 1-4 encounters a PCI
bus cycle which selects the region defined by it, the
APTA register will contain that current cycle’s active
address and the device asserts the signal PTATN#
(Pass-Thru ATentioN). Wait states are generated on
the PCI bus until this register is read (PCI bus writes)
or this register is written (PCI bus reads).
相關(guān)PDF資料
PDF描述
S5935QF PCI 5V Bus Master/Target Device 32-bit
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