- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄379205 > IBM3206K0424 (IBM Microeletronics) IBM Processor for Network Resources(異步轉(zhuǎn)換模式（ATM）32位微處理器（用于網(wǎng)絡(luò)資源管理）) PDF資料下載
參數(shù)資料
| 型號： | IBM3206K0424 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Processor for Network Resources(異步轉(zhuǎn)換模式（ATM）32位微處理器（用于網(wǎng)絡(luò)資源管理）) |
| 中文描述： | IBM的處理器（異步轉(zhuǎn)換模式（ATM）的32位微處理器的網(wǎng)絡(luò)資源（用于網(wǎng)絡(luò)資源管理）） |
| 文件頁數(shù)： | 5/676頁 |
| 文件大?。?/td> | 9810K |
| 代理商： | IBM3206K0424 |
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IBM3206K0424
Preliminary
IBM Processor for Network Resources
nrm.toc.01
August 14, 2000
Page 5
INTST CPB Capture Enable ..........................................................................................................144
INTST CPB Captured Address ......................................................................................................145
INTST General Purpose Timer Pre-scaler ....................................................................................145
INTST General Purpose Timer Compare ......................................................................................146
INTST General Purpose Timer Counter ........................................................................................146
INTST General Purpose Timer Status ...........................................................................................147
INTST General Purpose Timer Mode Control ...............................................................................148
INTST Enable for PCORE Normal Interrupt ..................................................................................149
INTST Enable for PCORE Critical Interrupt ...................................................................................149
INTST Debug States Control .........................................................................................................150
INTST Delayed Interrupts DMA System Address 1 .......................................................................152
INTST Delayed Interrupts DMA System Address 2 .......................................................................152
Current PCI Master Address Counter for Debug ...........................................................................152
External Entity States Read ...........................................................................................................153
DMA QUEUES (DMAQS) ....................................................................................................................154
DMA Descriptors ...........................................................................................................................154
DMA Types and Options ...............................................................................................................155
Descriptor Based DMAs ................................................................................................................156
Register Based DMAs ...................................................................................................................156
Polling, Interrupts, or Events .........................................................................................................156
Error Detection and Recovery .......................................................................................................156
DMA/Queue Scheduling Options ...................................................................................................156
Address Size .................................................................................................................................156
Data Width .....................................................................................................................................157
Initialization of DMAQS ..................................................................................................................157
DMAQS Lower Bound Registers ...................................................................................................158
DMAQS Upper Bound Registers ...................................................................................................159
DMAQS Head Pointer Registers ...................................................................................................160
DMAQS Tail Pointer Registers ......................................................................................................160
DMAQS Length Registers .............................................................................................................161
DMAQS Threshold Registers ........................................................................................................161
DMAQS Interrupt Status ................................................................................................................162
DMAQS Interrupt Enable ...............................................................................................................164
DMAQS Control Register ..............................................................................................................164
DMAQS Enqueue DMA Descriptor Primitive .................................................................................166
DMAQS Source Address Register ................................................................................................166
DMAQS Destination Address Register ..........................................................................................167
DMAQS Buffer Address Register ..................................................................................................167
DMAQS Transfer Count and Flag Register ...................................................................................168
DMAQS System Descriptor Address .............................................................................................171
DMAQS Checksum Register .........................................................................................................171
DMAQS Local Descriptor Range Registers ...................................................................................173
DMAQS Event Queue Number Register .......................................................................................173
DMAQS DMA Request Size Register ............................................................................................174
DMAQS Enq FIFO Register ..........................................................................................................174
General Purpose DMA (GPDMA) ......................................................................................................175
GPDMA Interrupt Status ................................................................................................................175
GPDMA Interrupt Enable ...............................................................................................................176
GPDMA Control Register ..............................................................................................................177
GPDMA Source Address Register ................................................................................................178
GPDMA Destination Address Register ..........................................................................................179
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