參數(shù)資料
型號: AM8530
廠商: Advanced Micro Devices, Inc.
英文描述: Serial Communications Controller
中文描述: 串行通信控制器
文件頁數(shù): 48/194頁
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代理商: AM8530
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I/O Programming Functional Description
AMD
3–17
In this mode, the
W
/
REQ
pin carries the Wait signal, and is open-drain when inactive and
Low when active. When the processor attempts to read data from the Receive Data FIFO
and it is empty, the SCC will assert
W
/
REQ
until a character has reached the top of the
FIFO. This allows the use of a block-move instruction to transfer the receive data.
W
/
REQ
will go active in response to
RD
going active, but only if RR8 (Receive Buffer) is being
accessed, either directly or via the pointers. The
W
/
REQ
pin is released in response to
the falling edge of PCLK. Details of the timing are shown in Figure 3–7.
3.9.3
The two DMA request pins,
W
/
REQ
and
DTR
/
REQ
, can be programmed to be used as
DMA requests. The
W
/
REQ
pin can be used as either a transmit or a receive request, but
the
DTR
/
REQ
pin can be used only as a transmit request. Hence, for full-duplex opera-
tion, the
W
/
REQ
pin should be used for receive and the
DTR
/
REQ
pin used for transmit.
These modes are described below.
DMA Requests
3.9.3.1
The DMA Request on Transmit function using the
W
/
REQ
pin is enabled by programming
WR1 as shown below.
DMA Request on Transmit (Using
W
/
REQ
)
1
1
0
D7
D6 D5
D4 D3
D2 D1
D0
WR1—DMA on Transmit Function Selection
ASYNC Modes
SYNC Modes
TRxC
PCLK
WAIT
Figure 3–6. Wait on Transmit Timing
ASYNC Modes
SYNC Modes
RTxC
PCLK
WAIT
1
2
3
4
5...8
9
10
11
12
13
Figure 3–7. Wait on Receive Timing
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