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參數(shù)資料
| 型號： | AM8530 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | Serial Communications Controller |
| 中文描述： | 串行通信控制器 |
| 文件頁數(shù)： | 16/194頁 |
| 文件大小： | 797K |
| 代理商： | AM8530 |
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General Information
AMD
1–8
1.5
Figure 1–4 designates the pin locations and signal names for the 40- and 44-pin SCC
versions.
PIN DES CRIPT IONS
1.5.1
A/
B
— Channel A/Channel B Select (input, Channel A active High)
This signal selects the channel in which the Read or Write operation occurs and must be
valid prior to the read or write strobe.
S ystem Interfac e Pin Desc riptions
CE
— Chip Enable (input, active Low)
This signal selects the SCC for operation. It must remain active throughout the bus
transaction.
D0–D7 — Data Lines (bidirectional, 3-state)
These I/O lines carry data or control information to and from the SCC.
D/
C
— Data/Control (input, data active High)
This signal defines the type of information transfer performed by the SCC: data or control.
The state of this signal must be valid prior to the read or write strobe.
RD
— Read (input, active Low)
This signal indicates a Read operation and, when the SCC is selected, enables the SCC
bus drivers. During the interrupt acknowledge cycle, this signal gates the interrupt vector
onto the bus provided that the SCC is the highest priority device requesting an interrupt.
WR
— Write (input, active Low)
When the SCC is selected, this signal indicates a Write operation. On the NMOS
Am8530H data must be valid prior to the rising edge of write strobe. The Am85C30 does
not share this requirement. The coincidence of
RD
and
WR
is interpreted as a Reset.
IEI* — Interrupt Enable In (input, active High)
IEI is used with IEO to form an interrupt daisy chain when there is more than one inter-
rupt-driven device. A High on IEI indicates that no other higher priority device has an In-
terrupt Under Service (IUS) or is requesting an interrupt.
IEO — Interrupt Enable Out (output, active High)
IEO is High only if IEI is High and the CPU is not servicing an SCC or SCC interrupt or
the controller is not requesting an interrupt (interrupt acknowledge cycle only). IEO is con-
nected to the next lower priority device’s IEI input and thus inhibits interrupts from lower
priority devices.
INTACK
* — Interrupt Acknowledge (input, active Low)
This signal indicates an active interrupt acknowledge cycle. During this cycle, the interrupt
daisy chain settles. When
RD
becomes active, the SCC places an interrupt vector on the
data bus (if IEI is High).
INTACK
is latched by the rising edge of PCLK.
INT
— Interrupt Request (output, open-drain, active Low)
This signal is activated when the SCC is requesting an interrupt.
Note:
*Pull-up resistors are needed on
INTACK
and IEI inputs if they are not driven by the
system and for the
INT
output. If
INTACK
or IEI are left floating, the Am85C30 will
malfunction.
INT
is an open drain output and must be pulled up to keep a logical high
level.
相關PDF資料 |
PDF描述 |
|---|---|
| AM8530H | Serial Communications Controller |
| AM85C30-10PC | Enhanced Serial Communications Controller |
| Am85C30 | Serial Communications Controller |
| AM85C30 | Enhanced Serial Communications Controller |
| AM85C30-8PC | Enhanced Serial Communications Controller |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| AM8530AJC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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| AM8530DC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
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